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參數(shù)資料
| 型號(hào)： | MCIMX27 |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Multimedia Applications Processor(多媒體應(yīng)用處理器) |
| 中文描述： | 多媒體應(yīng)用處理器（多媒體應(yīng)用處理器） |
| 文件頁數(shù)： | 81/118頁 |
| 文件大?。?/td> | 1159K |
| 代理商： | MCIMX27 |
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Signal Descriptions
i.MX27 Data Sheet, Advance Information, Rev. 0.1
Freescale Semiconductor
Preliminary—Subject to Change Without Notice
81
Figure 43. SLCDC Timing Diagram—Parallel Transfers to LCD Device
Table 43. SLCDC Serial Interface Timing Parameters
Symbol
Parameter
Min
Typ
Max
Units
t
css
Chip select setup time
(t
cyc
/ 2) (
±
) t
prop
(t
cyc
/ 2) (
±
) t
prop
39 (
±
) t
prop
—
—
ns
t
csh
Chip select hold time
—
—
ns
t
cyc
Serial clock cycle time
—
2641
ns
t
cl
Serial clock low pulse
18 (
±
) t
prop
—
—
ns
t
ch
Serial clock high pulse
18 (
±
) t
prop
—
—
ns
t
ds
Data setup time
(t
cyc
/ 2) (
±
) t
prop
—
—
ns
t
dh
Data hold time
(t
cyc
/ 2) (
±
) t
prop
—
—
ns
t
rss
Register select setup time
(15 * t
cyc
/ 2) (
±
) t
prop
—
—
ns
t
rsh
Register select hold time
(t
cyc
/ 2) (
±
) t
prop
—
—
ns
Table 44. SLCDC Parallel Interface Timing Parameters
Symbol
Parameter
Min
Typ
Max
Units
t
cyc
Parallel clock cycle time
78 (
±
) t
prop
—
4923
t
ds
Data setup time
(t
cyc
/ 2) (
±
) t
prop
—
—
t
dh
Data hold time
(t
cyc
/ 2) (
±
) t
prop
—
—
LCD_CLK
LCD_DATA[15:0]
LCD_RS
command data
LCD_CS
display data
trsh
trss
tds
tdh
tcyc
LCD_CLK
LCD_DATA[15:0]
LCD_RS
command data
LCD_CS
display data
trsh
trss
tds
tdh
tcyc
This diagram illustrates the timing when CSPOL=0
This diagram illustrates the timing when CSPOL=1
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