參數(shù)資料
型號： M69030
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA278
文件頁數(shù)： 4/387頁
文件大小： 2678K
代理商： M69030
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General Control and Status Registers
8-13
`efmp69030 Databook
Revision 1.3 11/24/99
MSS
Memory Space Shadowing Register
read/write at I/O address 3CBh
shared by both pipelines A and B
7-4
Reserved
These bits always return the value of 0 when read.
3
Memory Space Shadowing Enable
0: Disables memory space shadowing. All registers for pipeline A remain mapped to mem-
ory offsets 400000 through 7FFFFF. All registers for pipeline B remain mapped to memory
offsets C00000 through FFFFFF. This is the default after reset.
1: Enables memory space shadowing. All shadows of all registers for either pipeline A or
B (not both at the same time) are accessible at both memory offsets 400000 through
7FFFFF and C00000 through FFFFFF. The choice of which pipeline’s registers are to be
made accessible for reading or writing is controlled via bits 2 through 0 of this register.
2
Pipeline A or B Register Read Select
Note: This bit has no effect if bit 3 of this register is set to 0.
0: If bit 3 of this register is set to 1, then the registers belonging to or shared by pipeline A
are accessible for reading via both memory offsets 400000 through 7FFFFF and C00000
through FFFFFF, and those registers belonging exclusively to pipeline B are not. This is
the default after reset.
1: If bit 3 of this register is set to 1, then the registers belonging to or shared by pipeline B
are accessible for reading via both memory offsets 400000 through 7FFFFF and C00000
through FFFFFF, and those registers belonging exclusively to pipeline A are not.
1
Pipeline A Register Write Enable
Note: This bit has no effect if bit 3 of this register is set to 0.
0: If bit 3 of this register is set to 1, then the registers belonging exclusively to pipeline A
are NOT accessible for writing via either memory offsets 400000 through 7FFFFF or
C00000 through FFFFFF. This is the default after reset.
1: If bit 3 of this register is set to 1, then the registers belonging to or shared by pipeline A
are accessible for writing via memory offsets 400000 through 7FFFFF.
0
Pipeline B Register Write Enable
Note: This bit has no effect if bit 3 of this register is set to 0.
0: If bit 3 of this register is set to 1, then the registers belonging exclusively to pipeline B
are NOT accessible for writing via either memory offsets 400000 through 7FFFFF or
C00000 through FFFFFF. This is the default after reset.
1: If bit 3 of this register is set to 1, then the registers belonging to or shared by pipeline B
are accessible for writing via memory offsets C00000 through FFFFFF.
76
54
32
10
A
&
B
Reserved
(0000)
Mem Shad
En
(0)
A/B Reg
Read
(0)
Pipe A Reg
Write
(0)
Pipe B Reg
Write
(0)
相關(guān)PDF資料
PDF描述
MA4T85633 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MA4T85600 Si, RF POWER TRANSISTOR
MA4T85635 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MAT-02NBC 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
MAT-02NBCG 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
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參數(shù)描述
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M690SDM-R02 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R03 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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