參數(shù)資料
型號： M69030
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA278
文件頁數(shù)： 262/387頁
文件大?。?/td> 2678K
代理商： M69030
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18-2
Memory-Mapped Wide Extension Registers
`efmp69030 Databook
Revision 1.3 11/24/99
ER00
Central Interrupt Control Register
doubleword-writable, byte/word/doubleword-readable at memory offsets 0x400600 and 0xC00600
shared by both pipelines A and B
31
BitBLT Engine Idle Interrupt Output Enable
0: No hardware interrupt is output to the host when the BitBLT engine becomes idle after
performing a BitBLT operation.
1: Causes a hardware interrupt to be output to the host when the BitBLT engine becomes
idle after performing a BitBLT operation.
30
BitBLT Engine Command Queue Low Interrupt Pending
0: Since this bit was last cleared, no interrupt has been sourced as a result of the command
queue used by the BitBLT engine going below the low watermark.
1: An interrupt was sourced as a result of the command queue used by the BitBLT engine
going below the low watermark. Writing the value of 1 to this bit will clear it to 0 (writing the
value of 0 to this bit has no effect and will be ignored).
29-19 Reserved
These bits always return the value of 0 when read.
18
Pipeline B Vertical Blanking Period Interrupt Output Enable
0: No hardware interrupt is output to the host when the last pixel of the last scan line within
the active display area is drawn on pipeline B.
1: Causes a hardware interrupt to be output to the host when the last pixel of the last scan
line within the active display area is drawn on pipeline B.
This bit always return the value of 0 when read.
17-15 Reserved
These bits always return the value of 0 when read.
14
Pipeline A Vertical Blanking Period Interrupt Output Enable
0: No hardware interrupt is output to the host when the last pixel of the last scan line within
the active display area has been drawn on pipeline A.
1: Causes a hardware interrupt to be output to the host when the last pixel of the last scan
line within the active display area has been drawn on pipeline A.
13-7
Reserved
These bits always return the value of 0 when read.
6
Video Capture Vertical Sync Interrupt Output Enable
0: No hardware interrupt is output to the host at the start of each vertical sync pulse from
the acquisition data source.
1: Causes a hardware interrupt to be output to the host at the start of each vertical sync
pulse from the acquisition data source.
5-0
Reserved
These bits always return the value of 0 when read.
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
A
&
B
BBLT
Idle
(0)
BBLT
Queue
(0)
Reserved
(00:0000:0000:0)
Pipe B
V Blnk
(0)
Reserved
(00)
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
A
&
B
Rsvd
(0)
Pipe A
V Blnk
(0)
Reserved
(00:0000:0)
V Cap
VSync
(0)
Reserved
(00:0000)
相關PDF資料
PDF描述
MA4T85633 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MA4T85600 Si, RF POWER TRANSISTOR
MA4T85635 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MAT-02NBC 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
MAT-02NBCG 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
相關代理商/技術參數(shù)
參數(shù)描述
M69032 制造商:MITSUBISHI 制造商全稱:Mitsubishi Electric Semiconductor 功能描述:
M690SDM 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SIGE SINGLE FREQUENCY VCSO
M690SDM-R01 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R02 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R03 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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