參數(shù)資料
型號： M69030
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA278
文件頁數(shù)： 29/387頁
文件大?。?/td> 2678K
代理商： M69030
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9-22
CRT Controller Registers
`efmp69030 Databook
Revision 1.3 11/24/99
CR11
Vertical Sync End Register
read/write at I/O address 3B5h/3D5h with index at address 3B4h/3D4h set to 11h
shadowed for pipelines A and B
7
Protect Registers 0-7
0: Enable writes to registers CR00-CR07.
1: Disable writes to registers CR00-CR07.
Note: The ability to write to bit 4 of the Overflow Register (CR07) is not affected by this bit.
Bit 4 of the Overflow Register is always writable.
6
Reserved
Writes to this bit are ignored. In the VGA standard, this bit was used to switch between 3
and 5 frame buffer refresh cycles during the time required to draw each horizontal line.
5
Vertical Interrupt Enable
0: Enable the generation of an interrupt at the beginning of each vertical retrace period.
1: Disable the generation of an interrupt at the beginning of each vertical retrace period.
Note: The hardware does not actually provide an interrupt signal which would be
connected to an input of the system’s interrupt controller. Bit 7 of Input Status Register 0
(ST00) indicates the status of the vertical retrace interrupt, and can be polled by software
to determine if a vertical retrace interrupt has taken place. Bit 4 of this register can be used
to clear a pending vertical retrace interrupt.
4
Vertical Interrupt Clear
Setting this bit to 0 clears a pending vertical retrace interrupt. This bit must be set back to
1 to enable the generation of another vertical retrace interrupt.
Note: The hardware does not actually provide an interrupt signal which would be
connected to an input of the system’s interrupt controller. Bit 7 of Input Status Register 0
(ST00) indicates the status of the vertical retrace interrupt, and can be polled by software
to determine if a vertical retrace interrupt has taken place. Bit 5 of this register can be used
to enable or disable the generation of vertical retrace interrupts.
3-0
Vertical Sync End
These 4 bits provide a 4-bit value that specifies the end of the vertical sync pulse relative
to its beginning.
This 4-bit value should be set to the least significant 4 bits of the result of adding the length
of the vertical sync pulse in terms of the number of scanlines that occur within the length of
the vertical sync pulse to the value that specifies the beginning of the vertical sync pulse.
See the description of the Vertical Sync Start Register (CR10) for more details.
76543
210
A
Protect
Regs 0-7
Reserved
Vert Int
Enable
Vert Int
Clear
Vertical Sync End
B
Protect
Regs 0-7
Reserved
Vert Int
Enable
Vert Int
Clear
Vertical Sync End
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PDF描述
MA4T85633 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MA4T85600 Si, RF POWER TRANSISTOR
MA4T85635 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MAT-02NBC 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
MAT-02NBCG 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
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參數(shù)描述
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M690SDM 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SIGE SINGLE FREQUENCY VCSO
M690SDM-R01 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R02 功能描述:時鐘合成器/抖動清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R03 功能描述:時鐘合成器/抖動清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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