參數(shù)資料
型號(hào)： M69030
元件分類： 圖形處理器
英文描述： GRAPHICS PROCESSOR, PBGA278
文件頁(yè)數(shù)： 18/387頁(yè)
文件大?。?/td> 2678K
代理商： M69030
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9-12
CRT Controller Registers
`efmp69030 Databook
Revision 1.3 11/24/99
1
Vertical Display Enable End Bit 8
The vertical display enable end is a 10-bit or 12-bit value that specifies the number of the
last scanline within the active display area.
In standard VGA modes, where bit 0 of the I/O Control Register (XR09) is set to 0, the
vertical display enable end is specified with a 10-bit value. The 8 least significant bits of
the vertical display enable are supplied by bits 7-0 of the Vertical Display Enable End
Register (CR12), and the most and second-most significant bits are supplied by bit 6 and
bit 1 of this register (CR07), respectively.
In extended modes, where bit 0 of the I/O Control Register (XR09) is set to 1, the vertical
display enable end is specified with a 12-bit value. The 8 least significant bits of the vertical
display enable are supplied by bits 7-0 of the Vertical Display Enable End Register (CR12),
and the 4 most significant bits are supplied by bits 3-0 of the Extended Vertical Display End
Enable Register (CR31). In extended modes, neither bit 6 nor bit 1 of this register (CR07)
are used.
This 10-bit or 12-bit value should be programmed to be equal to the number of the last
scanline within in the active display area. Since the active display area always starts on
the 0th scanline, this number should be equal to the total number of scanlines within the
active display area minus 1.
0
Vertical Total Bit 8
The vertical total is a 10-bit or 12-bit value that specifies the total number of scanlines. This
includes the scanlines both inside and outside of the active display area.
In standard VGA modes, where bit 0 of the I/O Control Register (XR09) is set to 0, the
vertical total is specified with a 10-bit value. The 8 least significant bits of the vertical total
are supplied by bits 7-0 of the Vertical Total Register (CR06), and the most and second-
most significant bits are supplied by bit 5 and bit 0 of this register (CR07), respectively.
In extended modes, where bit 0 of the I/O Control Register (XR09) is set to 1, the vertical
total is specified with a 12-bit value. The 8 least significant bits of the vertical total are
supplied by bits 7-0 of the Vertical Total Register (CR06), and the 4 most significant bits are
supplied by 3-0 bits of the Extended Vertical Total Register (CR30). In extended modes,
neither bit 5 nor bit 0 of this register (CR07) are used.
This 10-bit or 12-bit value should be programmed to be equal to the total number of
scanlines minus 2.
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PDF描述
MA4T85633 C BAND, Si, NPN, RF SMALL SIGNAL TRANSISTOR
MA4T85600 Si, RF POWER TRANSISTOR
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MAT-02NBC 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
MAT-02NBCG 20 mA, 40 V, 2 CHANNEL, NPN, Si, SMALL SIGNAL TRANSISTOR
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參數(shù)描述
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M690SDM 制造商:IDT 制造商全稱:Integrated Device Technology 功能描述:SIGE SINGLE FREQUENCY VCSO
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M690SDM-R02 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 VCSO RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
M690SDM-R03 功能描述:時(shí)鐘合成器/抖動(dòng)清除器 RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
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