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參數(shù)資料
| 型號(hào)： | M37641M8-XXXHP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM, PLASTIC, LQFP-80 |
| 文件頁(yè)數(shù)： | 147/385頁(yè) |
| 文件大小： | 3339K |
| 代理商： | M37641M8-XXXHP |
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Rev.2.00
Aug 28, 2006
page 99 of 148
7641 Group
REJ09B0336-0200
APPLICATION
2.5 DMAC
2.5.7 Notes on DMAC
(1) Transfer time
One-byte data transfer requires 2 cycles of
φ (read and write cycles).
To perform DMAC transfer due to the different transfer requests on the same DMAC channel or
DMAC transfer between both DMAC channels, 1 cycle of
φ or more is needed before transfer is
started.
(2) Priority
The DMAC places a higher priority on channel-0 transfer requests than on channel-1 transfer
requests.
If a channel-0 transfer request occurs during a channel-1 burst transfer operation, the DMAC
completes the next transfer source and destination read/write operation first, and then stops the
channel-1 transfer operation.
The channel-1 transfer operation which has been suspended is automatically resumed from the
point where it was suspended so that channel-1 transfer can complete its one-burst transfer unit.
This will be performed even if another channel-0 transfer request occurs.
The suspended transfer due to the interrupt can also be resumed during its interrupt process
routine by writing “1” to the DMAC channel x enable bit (DxCEN).
(3) Related registers
A read/write must be performed to the source registers, transfer destination registers and transfer
count registers as follows:
Read from each higher byte first, then the lower byte
Write to each lower byte first, then the higher byte.
Note that if the lower byte is read out first, the values are the higher byte’s.
Do not access the DMAC-related registers by using a DMAC transfer. The destination address
data and the source address data will collide in the DMAC internal bus.
When setting the DMAC channel x enable bit (bit 7 of address 4116) to “1”, be sure simultaneously
to set the DMAC channel x transfer initiation source capture register reset bit (bit 6 of address
4116) to “1”. If this is not performed, an incorrect data will be transferred at the same time when
the DMAC is enabled.
(4) USB transfer
One signal among USB endpoint signals 1 to 4 can be selected as the hardware transfer request
source. This can realize that transfer between the USB FIFO and the master CPU bus interface
input/output buffer is performed effectively. This transfer function is only valid in the cycle steal
transfer mode.
(5) DMAOUT pin
In the memory expansion mode and microprocessor mode, the DMAOUT pin (P33/DMAOUT) outputs
“H” during a DMA transfer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M37641F8HP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643F8FP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643F8HP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643M8-XXXHP | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37702S1LGP | 16-BIT, 8 MHz, MICROCONTROLLER, PQFP80 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M376420RS | 制造商:OKI 功能描述:3764-20 NOTES |
| M3764-20RS | 制造商:OKI 功能描述:3764-20 NOTES 制造商: 功能描述:Dynamic RAM, Page Mode, 64K x 1, 16 Pin, Plastic, DIP 制造商:OK International 功能描述:Dynamic RAM, Page Mode, 64K x 1, 16 Pin, Plastic, DIP |
| M3-7643A-S | 制造商:Harris Corporation 功能描述: |
| M37643F8E8-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| M37643F8M8-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
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