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參數(shù)資料
| 型號： | M37641M8-XXXHP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 12 X 12 MM, 0.50 MM, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 126/385頁 |
| 文件大小： | 3339K |
| 代理商： | M37641M8-XXXHP |
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Rev.2.00
Aug 28, 2006
page 80 of 148
7641 Group
REJ09B0336-0200
APPLICATION
2.5 DMAC
2.5.2 Related registers
(1) DMAC index and status register
DMAC channel x (x = 0, 1) count register underflow flag (DxUF)
When the corresponding transfer count register Low (address 4616) underflows, this DxUF flag is
set to “1”. Writing “0” into this flag clears it.
DMAC channel x (x = 0, 1) suspend flag (DxSFI)
When an interrupt routine is processed during any DMA operation, the transfer operation is suspended
and the DMAC automatically sets the corresponding DxSFI flag to “1”. As soon as the CPU
completes the interrupt operation, the DMAC clears the DxSFI flag to “0” and resumes the original
operation from the point where it was suspended.
DMAC transfer suspend control bit (DTSC)
This bit specifies the transfer mode which can be suspended by an interrupt process.
DMAC register reload disable bit (DRLDD)
If the DRLDD bit is “1”, when the DMAC channel x transfer count register underflows, the DMAC
channel x source registers and destination registers are disabled from being reloaded from their
latches.
Channel index bit (DCI)
The related registers of channels 1 and 2 are assigned on the same SFR addresses. This DCI bit
specifies the accessible channel.
Fig. 2.5.2 Structure of DMAC index and status register
DMAC index and status register
b7 b6 b5 b4 b3 b2 b1 b0
DMAC index and status register
(DMAIS : address 3F16)
b
0
1
2
4
Name
0
Functions
At reset R W
0
DMAC channel 0 suspend
flag (D0SFI) (Note 1)
DMAC transfer suspend
control bit (DTSC) (Note 2)
DMAC channel 1 count
register underflow flag (D1UF)
0 : No underflow
1 : Underflow generated
0 : Not suspended
1 : Suspended
DMAC channel 1 suspend
flag (D1SFI) (Note 1)
0 : No underflow
1 : Underflow generated
5
0
DMAC register reload
disable bit (DRLDD)
(Note 3)
7
0
Channel index bit (DCI)
0 : Channel 0 accessible
1 : Channel 1 accessible
Accessed registers: Mode register,
source register, destination register,
transfer count register.
0
DMAC channel 0 count
register underflow flag (D0UF)
Fix this bit to “0”.
3
0 : Not suspended
1 : Suspended
0 :Suspending only burst transfers during
interrupt process
1 : Suspending both burst and cycle steal
transfers during interrupt process
0 :Enabling reload of source and
destination registers of both channels
1 : Disabling reload of source and
destination registers of both channels
6
Notes 1: Suspended by an interrupt.
2: Transfer suspended during interrupt process
3: This settings affect the source and destination registers of both channels.
: “0” can be set by software, but “1” cannot be set.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M37641F8HP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643F8FP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643F8HP | 8-BIT, FLASH, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37643M8-XXXHP | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP80 |
| M37702S1LGP | 16-BIT, 8 MHz, MICROCONTROLLER, PQFP80 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M376420RS | 制造商:OKI 功能描述:3764-20 NOTES |
| M3764-20RS | 制造商:OKI 功能描述:3764-20 NOTES 制造商: 功能描述:Dynamic RAM, Page Mode, 64K x 1, 16 Pin, Plastic, DIP 制造商:OK International 功能描述:Dynamic RAM, Page Mode, 64K x 1, 16 Pin, Plastic, DIP |
| M3-7643A-S | 制造商:Harris Corporation 功能描述: |
| M37643F8E8-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
| M37643F8M8-XXXFP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER |
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