參數(shù)資料
型號： M30833FJFP
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 30 MHz, MICROCONTROLLER, PQFP100
封裝： PLASTIC, QFP-100
文件頁數(shù)： 62/159頁
文件大小： 3896K
代理商： M30833FJFP
Rev.3.00
2004.08.06
page 152 of 155
REJ03B0010-0300Z
4584 Group
PRELIMINARY
Notice: This is not a final specification.
Some parametric limits are subject to change.
BASIC TIMING DIAGRAM
VOLTAGE DROP DETECTION CIRCUIT CHARACTERISTICS
(Ta = –20 °C to 85 °C, unless otherwise noted)
Test conditions
Ta = 25 °C
VDD = 5 V
VDD = 3 V
VDD
→ (VRST– – 0.1 V) (Note 4)
Parameter
Detection voltage
(reset occurs) (Note 1)
Detection voltage
(reset release) (Note 2)
Detection voltage hysteresis
Operation current (Note 3)
Detection time
Symbol
VRST–
VRST+
VRST+ –
VRST–
IRST
TRST
Limits
Unit
Min.
1.4
1.1
1.5
1.2
Typ.
1.5
1.6
0.1
50
30
0.2
Max.
1.6
1.9
1.7
2.0
100
60
1.2
V
A
ms
Notes 1: The detected voltage (VRST–) is defined as the voltage when reset occurs when the supply voltage (VDD) is falling.
2: The detected voltage (VRST+) is defined as the voltage when reset is released when the supply voltage (VDD) is rising from reset occurs.
3: When the voltage drop detection circuit is used (VDCE pin = “H”), IRST is added to IDD (power current).
4: The detection time (TRST) is defined as the time until reset occurs when the supply voltage (VDD) is falling to [VRST– – 0.1 V].
STCK
Parameter
Pin (signal) name
Machine cycle
Mi
Mi+1
D0– D6
System clock
Port D output
Port D input
Ports P0, P1, P2, P3,
P4, P5, P6 output
Ports P0, P1, P2, P3,
P4, P5, P6 input
D0– D6
INT0, INT1
Interrupt input
P00– P03
P10– P13
P00– P03
P10– P13
P20– P23
P30– P33
P20– P23
P30– P33
P40– P43
P50– P53
P60– P63
P50– P53
P60– P63
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