參數(shù)資料
型號(hào)： ISP1582
廠商： NXP Semiconductors N.V.
英文描述： Hi-Speed Universal Serial Bus peripheral controller
中文描述： 高速通用串行總線外設(shè)控制器
文件頁數(shù)： 59/66頁
文件大小： 325K
代理商： ISP1582
Philips Semiconductors
ISP1582
Hi-Speed USB peripheral controller
Preliminary data
Rev. 03 — 25 August 2004
59 of 66
9397 750 13699
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
DREQ is asserted for every transfer.
Data strobes: DIOR (read) and DACK (write).
(1) Programmable polarity: shown as active LOW.
(2) Programmable polarity: shown as active HIGH.
Fig 21. GDMA (slave) mode timing (bits MODE[1:0] = 01).
td1
tw1
tsu1
th1
tsu2
td2
th2
Tcy1
(write) DATA[15:0]
(read) DATA[15:0]
DREQ
(2)
DACK
(1)
DIOR/DIOW
(1)
MGT502
tsu3
ta1
th3
DREQ is continuously asserted until the last transfer is done or the FIFO is full.
Data strobe: DACK (read/write).
(1) Programmable polarity: shown as active LOW.
(2) Programmable polarity: shown as active HIGH.
Fig 22. GDMA (slave) mode timing (bits MODE[1:0] = 10).
th1
tw1
tsu1
td1
tsu2
td2
th2
Tcy1
(write) DATA[15:0]
(read) DATA[15:0]
DREQ
(2)
HIGH
DACK
(1)
DIOR/DIOW
(1)
MGT501
tw2
th3
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PDF描述
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