參數(shù)資料
型號(hào)： ISP1582
廠商： NXP Semiconductors N.V.
英文描述： Hi-Speed Universal Serial Bus peripheral controller
中文描述： 高速通用串行總線外設(shè)控制器
文件頁數(shù)： 37/66頁
文件大?。?/td> 325K
代理商： ISP1582
Philips Semiconductors
ISP1582
Hi-Speed USB peripheral controller
Preliminary data
Rev. 03 — 25 August 2004
37 of 66
9397 750 13699
Koninklijke Philips Electronics N.V. 2004. All rights reserved.
Each programmable FIFO can be independently configured via its Endpoint
MaxPacketSize register (R/W: 04h), but the total physical size of all enabled
endpoints (IN plus OUT) must not exceed 8192 bytes.
9.3.7
Endpoint Type register (address: 08h)
This register sets the endpoint type of the indexed endpoint: isochronous, bulk or
interrupt. It also serves to enable the endpoint and configure it for double buffering.
Automatic generation of an empty packet for a zero-length TX buffer can be disabled
using bit NOEMPKT. The register contains 2 bytes, and the bit allocation is shown in
Table 44
.
Table 42:
Bit
15 to 13
12 to 11
Endpoint MaxPacketSize register: bit description
Symbol
Description
-
reserved
NTRANS[1:0]
Number of Transactions
. HS mode only.
00 —
1 packet per microframe
01 —
2 packets per microframe
10 —
3 packets per microframe
11 —
reserved.
These bits are applicable only for isochronous or interrupt
transactions.
FIFO Size
: Sets the FIFO size, in bytes, for the indexed endpoint.
Applies to both high-speed and full-speed operations (see
Table 43
).
10 to 0
FFOSZ[10:0]
Table 43:
NTRANS[1:0]
0h
0h
0h
0h
0h
0h
0h
2h
Programmable FIFO size
FFOSZ[10:0]
08h
10h
20h
40h
80h
100h
200h
400h
Non-isochronous
8 bytes
16 bytes
32 bytes
64 bytes
128 bytes
256 bytes
512 bytes
-
Isochronous
-
-
-
-
-
-
-
3072 bytes
Table 44:
Bit
Symbol
Reset
Bus reset
Access
Endpoint Type register: bit allocation
15
14
13
12
11
10
9
8
reserved
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
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PDF描述
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