參數(shù)資料
型號： ISP1561BM
廠商： NXP SEMICONDUCTORS
元件分類： 總線控制器
英文描述： ISP1561BM
中文描述： UNIVERSAL SERIAL BUS CONTROLLER, PQFP128
封裝： 14 X 14 MM, 1.40 MM HEIGHT, PLASTIC, MS-026, SOT-420-1, LQFP-128
文件頁數(shù)： 47/102頁
文件大?。?/td> 2875K
代理商： ISP1561BM
Philips Semiconductors
ISP1561
USB PCI host controller
Product data
Rev. 01 — 06 February 2003
47 of 102
9397 750 10015
Koninklijke Philips Electronics N.V. 2003. All rights reserved.
in the lower order bits. The minimum alignment is 256 bytes; therefore, bits 0 through
7 will always return logic 0 when read. This area is used to hold the control structures
and the Interrupt table that are accessed by both the Host Controller and the HCD.
11.1.8
HcPeriodCurrentED register (address: value read from func0 or func1 of
address 10H
+
1CH)
The HcPeriodCurrentED register contains the physical address of the current
Isochronous or Interrupt ED.
Table 56
gives the bit allocation of the register.
Table 54:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcHCCA register: bit allocation
31
30
29
28
27
26
25
24
HCCA[23:16]
0
R/W
20
HCCA[15:8]
0
R/W
12
HCCA[7:0]
0
R/W
4
reserved
0
-
0
0
0
0
0
0
0
R/W
23
R/W
22
R/W
21
R/W
19
R/W
18
R/W
17
R/W
16
0
0
0
0
0
0
0
R/W
15
R/W
14
R/W
13
R/W
11
R/W
10
R/W
9
R/W
8
0
0
0
0
0
0
0
R/W
7
R/W
6
R/W
5
R/W
3
R/W
2
R/W
1
R/W
0
0
-
0
-
0
-
0
-
0
-
0
-
0
-
Table 55:
Bit
31 to 8
HcHCCA register: bit description
Symbol
Description
HCCA[23:0]
Host Controller Communication Area Base Address
: This is
the base address of the HCCA.
-
reserved
7 to 0
Table 56:
Bit
Symbol
Reset
Access
Bit
Symbol
Reset
Access
HcPeriodicCurrentED register: bit allocation
31
30
29
28
27
26
25
24
PCED[27:20]
0
R
20
PCED[19:12]
0
R
0
R
23
0
R
22
0
R
21
0
R
19
0
R
18
0
R
17
0
R
16
0
R
0
R
0
R
0
R
0
R
0
R
0
R
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