參數(shù)資料
型號： IDT821034
廠商： Integrated Device Technology, Inc.
元件分類： Codec
英文描述： QUAD PCM CODEC WITH PROGRAMMABLE GAIN
中文描述： 四的PCM編解碼器，具有可編程增益
文件頁數(shù)： 42/52頁
文件大?。?/td> 609K
代理商： IDT821034
42
INDUSTRIAL TEMPERATURE RANGES
IDT82V2058 OCTAL E1 SHORT HAUL LINE INTERFACE UNIT
TRANSCEIVER TIMING CHARACTERISTICS
Symbol
Parameter
Min
Typ
2.048
Max
Unit
MHz
ppm
%
MCLK frequency
MCLK tolerance
MCLK duty cycle
-100
40
100
60
Transmit path
t1
t2
Receive path
t4
t5
t6
t7
t8
t9
TCLK frequency
TCLK tolerance
TCLK Duty Cycle
Transmit Data Setup Time
Transmit Data Hold Time
Delay time of OE low to driver High Z
Delay time of TCLK low to driver High Z
2.048
44
MHz
ppm
%
ns
ns
us
us
-50
10
40
40
40
+50
90
1
48
Clock recovery capture range
(1)
RCLK duty cycle
(2)
RCLK pulse width
(2)
RCLK pulse width low time
RCLK pulse width high time
Rise/fall time
(3)
Receive Data Setup Time
Receive Data Hold Time
RDN/RDP pulse width (MCLK = H)
(4)
+/- 80
50
488
244
244
244
244
244
ppm
%
ns
ns
ns
ns
ns
ns
ns
40
457
203
203
20
200
200
200
60
519
285
285
NOTE:
1. Relative to nominal frequency, MCLK=+/-100 ppm
2. RCLK duty cycle widths will vary depending on extent of received pulse jitter displacement. Maximum and minimum RCLK duty cycles are for worst case jitter conditions (0.2UI displacement
for E1 per ITU G.823).
3. For all digital outputs. C load = 15 pF
4. Clock recovery is disabled in this mode.
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PDF描述
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參數(shù)描述
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