參數(shù)資料
型號： IDT821034
廠商： Integrated Device Technology, Inc.
元件分類： Codec
英文描述： QUAD PCM CODEC WITH PROGRAMMABLE GAIN
中文描述： 四的PCM編解碼器，具有可編程增益
文件頁數(shù)： 41/52頁
文件大?。?/td> 609K
代理商： IDT821034
41
INDUSTRIAL TEMPERATURE RANGES
IDT82V2058 OCTAL E1 SHORT HAUL LINE INTERFACE UNIT
Symbol
f
-3dB
Parameter
Min
Typ
Max
Unit
Jitter Transfer Function Corner (–3dB) Frequency
Host mode: 32/64 bit FIFO
JABW = 0:
JABW = 1:
Hardware mode
Jitter Attenuator
(1)
@ 3 Hz
@ 40 Hz
@ 400 Hz
@ 100kHz
Jitter Attenuator Latency Delay
32bit FIFO:
64bit FIFO:
Input jitter tolerance before FIFO overflow or underflow
32bit FIFO:
64bit FIFO:
Output jitter in remote loopback
(2)
1.7
6.6
1.7
Hz
Hz
Hz
-0.5
-0.5
+19.5
+19.5
dB
td
16
32
U.I.
U.I.
28
56
U.I.
U.I.
U.I.
0.11
NOTE:
1. Per G.736, see
Fig-35.
2. Per ETSI CTR12/13 Output jitter.
RECEIVER CHARACTERISTICS
Symbol
ATT
IA
SIR
SRE
Parameter
Min
0.1
-14
Typ
50
150
310
230
32
2048
Max
15
0.8
Unit
dB
Vp
dB
%
mV
mV
mV
Permissible Cable Attenuation (@1024kHz)
Input Amplitude
Signal to Interference Ratio Margin
(1)
Data decision threshold (reference to peak input voltage)
Data slicer threshold
Analog loss of signal
(2)
Threshold:
Hysteresis:
Allowable consecutive zeros before LOS
E1, G.775:
E1, ETSI300233:
LOS reset
Clock recovery mode
Peak to Peak Intrinsic Receive Jitter (JA disabled)
Jitter Tolerance
1 Hz – 20 Hz
20 Hz – 2.4 KHz
18 KHz – 100 KHz
Receiver Differential Input Impedance
Receiver Common Mode Input Impedance to GND
Receive Return Loss
51 KHz – 102 KHz
102 KHz - 2.048 MHz
2.048 MHz – 3.072 MHz
Receive path delay
Dual rail
Single rail
12.5
18.0
1.5
0.2
10
20
20
20
% ones
U.I.
U.I.
U.I.
U.I.
K
K
db
dB
dB
U.I.
U.I.
JRX
p-p
JTRX
0.0625
ZDM
ZCM
RRX
120
3
8
NOTE:
1. E1: per G.703, O.151 @6dB cable attenuation.
2. The test circuit for this parameter is shown in Figure 12. The analog signal is measured on the Receiver line before the transformer (port A and port B in Figure 12). And
the receive line is a T1/E1 cable simulator.
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PDF描述
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參數(shù)描述
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