- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379205 > IBM25CPC710AB3A100 (IBM Microeletronics) IBM Dual Bridge and Memory Controller(IBM雙橋和存儲器控制器（連接帶同步動態(tài)RAM存儲器的Power PC 60x總線和兩個(gè)PCI端口）) PDF資料下載
參數(shù)資料
| 型號： | IBM25CPC710AB3A100 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Dual Bridge and Memory Controller(IBM雙橋和存儲器控制器（連接帶同步動態(tài)RAM存儲器的Power PC 60x總線和兩個(gè)PCI端口）) |
| 中文描述： | IBM的雙橋和內(nèi)存控制器（IBM的雙橋和存儲器控制器（連接帶同步動態(tài)RAM的存儲器的Power PC處理器60倍的PCI總線和兩個(gè)端口）） |
| 文件頁數(shù)： | 32/224頁 |
| 文件大?。?/td> | 3278K |
| 代理商： | IBM25CPC710AB3A100 |
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IBM25CPC710AB3A100
IBM Dual Bridge and Memory Controller
Page 20 of 208
dbamc01_ch2.fm.01
July 13, 2000
Table 5: PCI-32 Bus Interface Signals
Signal Name
I/O
Type
Description
P_ADL[0:31]
I/O
32-bit Multiplexed Address/Data: A write operation is defined as the transfer of data
from the PCI bus master to a PCI slave device on the PCI Bus.
P_CBE[0:3]
I/O
Bus Command/Byte Enable
P_DEVSEL
I/O
Device Select
P_FRAME
I/O
Cycle Frame: Driven by the current master to indicate the beginning and duration of an
access.
P_IRDY
I/O
Initiator Ready
P_ISA_MASTER
I
Pull-up
ISA Master: Indicates device must automatically P_DEVSEL the current DMA transfer
and must not translate the PCI address before sending the address to memory.
P_LOCK
O
Lock: Used to establish, maintain, and release resource locks on PCI-64.
P_MEMACK
O
Memory Acknowledge: Indicates device has flushed all CPU to PCI-32 bus buffers and
any CPU access to PCI stops are being SYS_ARTRYed.
P_MEMREQ
I
Pull-up
Memory Request: Indicates a PCI device accessing system memory has a potential
deadlock and requests device flush all posted CPU to PCI buffers and ARTRY all PCI-
32 bus transfers from the 60x bus.
P_PAR
I/O
Parity Bit
P_GNT[0:6]
O
PCI-32 Bus Grants
P_REQ[0:6]
I
Pull-up
PCI-32 Bus Requests
P_RST
O
PCI-32 Bus
P_PERR
I/O
PCI-32 Data Parity Error
P_SERR
I/O
PCI-32 System Parity Error: Reports parity errors on address, special cycle data, or
systems.
P_STOP
I/O
Stop: Asserted by the target to request the master to stop current transaction.
P_TRDY
I/O
Target Ready: Asserted by the target when ready to receive data.
P_CFG[0:2]
O
Configuration Bit Reflect: Reflects PCI-32 configuration bits 13-11 in the CONFIG
ADDR register. Set to zero when bits 14 or 15 are on.
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