- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄379205 > IBM25CPC710AB3A100 (IBM Microeletronics) IBM Dual Bridge and Memory Controller(IBM雙橋和存儲器控制器（連接帶同步動態(tài)RAM存儲器的Power PC 60x總線和兩個(gè)PCI端口）) PDF資料下載
參數(shù)資料
| 型號： | IBM25CPC710AB3A100 |
| 廠商： | IBM Microeletronics |
| 英文描述： | IBM Dual Bridge and Memory Controller(IBM雙橋和存儲器控制器（連接帶同步動態(tài)RAM存儲器的Power PC 60x總線和兩個(gè)PCI端口）) |
| 中文描述： | IBM的雙橋和內(nèi)存控制器（IBM的雙橋和存儲器控制器（連接帶同步動態(tài)RAM的存儲器的Power PC處理器60倍的PCI總線和兩個(gè)端口）） |
| 文件頁數(shù)： | 197/224頁 |
| 文件大?。?/td> | 3278K |
| 代理商： | IBM25CPC710AB3A100 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁第190頁第191頁第192頁第193頁第194頁第195頁第196頁當(dāng)前第197頁第198頁第199頁第200頁第201頁第202頁第203頁第204頁第205頁第206頁第207頁第208頁第209頁第210頁第211頁第212頁第213頁第214頁第215頁第216頁第217頁第218頁第219頁第220頁第221頁第222頁第223頁第224頁
IBM25CPC710AB3A100
IBM Dual Bridge and Memory Controller
dbamc01_ch5.fm.01
July 13, 2000
Page 185 of 208
5.5.3.1 TYPE 0 Configuration Cycles
For TYPE 0 configuration cycles to devices on the PCI bus connected to the bridge, the
IBM25CPC710AB3A100 indirectly supports up to eight separate IDSEL lines. It relies on external 3-8
decoders to provide a unique signal for each device on the bus. The IBM25CPC710AB3A100 drives external
address bits 13 through 11 (Little Endian) using the three PCI_CFG signals. It also drives PCI address/data
bus bits 31 through 11 as shown in the following table.
The recommended external connection for the 3-8 decoders is shown below.
PCI-32 Bus Device Physical
Connection Example
on page 179 describes a desktop example of system PCI device physical connections.
5.5.3.2 Type 1 Configuration Cycles
For TYPE 1 configuration cycles, the IBM25CPC710AB3A100 directly copies the contents of the
CONFIG_ADDRESS register to the Address/Data signals on the PCI bus. However, Address/Data[1:0]
contains
’
01
’
to indicate a TYPE 1 configuration cycle.
Figure 27: PCI Address/Data Bus for TYPE 0 Configuration Cycles
Figure 28: External IDSEL Signal Logic for PCI-32
Only One
“
1
”
0 0
Register No.
Register No.
Device
Bus Number
Reserved
E
31 30
0
CONFIG_ADDRESS
PCI Addr/Data Bus
24 23
16 15
11 10
8 7
2 1
31
0
Decoded in
11 10
0 0 0
0
0
0 0 0 0 0
0
0
0 0 0 0 0
0
0
0 1
0 0 0
0
0
0 0 0 0 0
0
0
0 0 0 0 0
0
0
1 0
0 0 0
0
0
0 0 0 0 0
0
0
0 0 0 0 0
1
0
0 0
Device = 1
Device = 2
Device = 3
Etc .......
the IBM25CPC710AB3A100
Function
Function
0 0
3 - 8
Decoder
A
C
B
0
1
2
3
4
5
6
7
P_PCI_CFG0
P_PCI_CFG1
P_PCI_CFG2
IDSEL0
IDSEL1
IDSEL2
IDSEL3
IDSEL4
IDSEL5
IDSEL6
IDSEL7
Not Connected
See Device Table
IBM25CPC710AB3A100
CONFIG_ADDRESS11
CONFIG_ADDRESS12
CONFIG_ADDRESS13
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