參數(shù)資料
型號(hào)： HM5212805DLTD-10
元件分類(lèi)： DRAM
英文描述： 16M X 8 SYNCHRONOUS DRAM, 8 ns, PDSO54
封裝： 0.400 INCH, PLASTIC, TSOP2-54
文件頁(yè)數(shù)： 44/53頁(yè)
文件大?。?/td> 552K
代理商： HM5212805DLTD-10
HM5212165D Series, HM5212805D Series
49
Clock Suspend Mode
012
3
4
5
6
7
8
9
1011
1213
141516
171819
20
R:a
C:a
R:b
a
a+1 a+2
a+3
b
b+1 b+2
R:a
C:a R:b
C:b
a
a+1 a+2
b
b+1 b+2 b+3
C:b
Bank0
Active
Active clock
suspend start
Active clock
supend end
Bank0
Read
Bank3
Active
Read suspend
start
Read suspend
end
Bank0
Precharge
Bank3
Read
Earliest Bank3
Precharge
Bank0
Write
Bank0
Active
Active clock
suspend start
Active clock
suspend end
Bank3
Active
Write suspend
start
Write suspend
end
Bank3
Write
Bank0
Precharge
Earliest Bank3
Precharge
b+3
CKE
RAS
CS
CAS
WE
Address
DQM,
DQMU/DQML
CLK
BS
CKE
RAS
CS
CAS
WE
Address
DQM,
DQMU/DQML
BS
a+3
High-Z
tCES
tCEH
tCES
Read cycle
RAS-CAS delay = 2
CAS latency = 2
Burst length = 4
= V
or V
IH
IL
Write cycle
RAS-CAS delay = 2
CAS latency = 2
Burst length = 4
= V
or V
IH
IL
DQ (output)
DQ (input)
DQ (output)
DQ (input)
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PDF描述
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