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參數(shù)資料
| 型號： | FW323 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機控制器接口 |
| 文件頁數(shù)： | 94/152頁 |
| 文件大?。?/td> | 1625K |
| 代理商： | FW323 |
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94
Agere Systems Inc.
FW323 05
1394A PCI PHY/Link Open Host Controller Interface
Data Sheet, Rev. 2
October 2001
Internal Registers
(continued)
Isochronous Receive Interrupt Event Register
The isochronous receive interrupt event set/clear register reflects the interrupt state of the isochronous receive
contexts. An interrupt is generated on behalf of an isochronous receive context if an INPUT_* command
completes and its interrupt bits are set. Upon determining that the interrupt event register isochRx (bit 7) interrupt
has occurred, software can check this register to determine which context(s) caused the interrupt. The interrupt
bits are set by an asserting edge of the corresponding interrupt signal, or by writing a 1 in the corresponding bit in
the set register. The only mechanism to clear the bits in this register is to write a 1 to the corresponding bit in the
clear register
Table 81. Isochronous Receive Interrupt Event Register
Bit
Field
Name
Reserved
Type
Default
31
30
29
28
27
26
25
24
23
22
21
20
19
18
17
16
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
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0
0
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0
0
0
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0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
isoRecv7
isoRecv6
isoRecv5
isoRecv4
isoRecv3
isoRecv2
isoRecv1
isoRecv0
RSCU
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相關PDF資料 |
PDF描述 |
|---|---|
| FW32305 | 1394A PCI PHY/Link Open Host Controller Interface |
| FW352 | |
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| FW801A-DB | Low-Power PHY IEEE 1394A-2000 One-Cable Transceiver/Arbiter Device |
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參數(shù)描述 |
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