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參數(shù)資料
| 型號(hào)： | FW323 |
| 英文描述： | 1394A PCI PHY/Link Open Host Controller Interface |
| 中文描述： | 1394A端口物理層的PCI /鏈接開放主機(jī)控制器接口 |
| 文件頁數(shù)： | 120/152頁 |
| 文件大小： | 1625K |
| 代理商： | FW323 |
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120
Agere Systems Inc.
FW323 05
1394A PCI PHY/Link Open Host Controller Interface
Data Sheet, Rev. 2
October 2001
Internal Registers
(continued)
Register:
Type:
Offset:
Asynchronous context control register
Read/set/clear/update
180h set register (ATRQ)
184h clear register (ATRQ)
1A0h set register (ATRS)
1A4h clear register (ATRS)
1C0h set register (ARRQ)
1C4h clear register (ARRQ)
1E0h set register (ATRS)
1E4h clear register (ATRS)
0000 X0XXh
Default:
Table 103. Asynchronous Context Control Register Description
Bit
31:16
15
Field Name
Reserved
run
Type
R
RSCU
Description
Reserved.
Bits 31:16 return 0s when read.
This bit is set by software to enable descriptor processing for the
context and cleared by software to stop descriptor processing. The
FW323 changes this bit only on a hardware or software reset.
Reserved.
Bits 14:13 return 0s when read.
Software sets this bit to cause the FW323 to continue or resume
descriptor processing. The FW323 clears this bit on every descriptor
fetch.
The FW323 sets this bit when it encounters a fatal error and clears the
bit when software resets bit 15 (run).
The FW323 sets this bit to 1 when it is processing descriptors.
Reserved.
Bits 9:8 return 0s when read.
This field indicates the speed at which a packet was received or trans-
mitted, and only contains meaningful information for receive contexts.
This field is encoded as:
14:13
12
Reserved
wake
R
RSU
11
dead
RU
10
9:8
7:5
active
Reserved
spd
RU
R
RU
000 = 100 Mbits/s.
001 = 200 Mbits/s.
010 = 400 Mbits/s, and all other values are reserved.
This field holds the acknowledge sent by the link core for this packet or
an internally generated error code if the packet was not transferred
successfully.
4:0
eventcode
RU
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| FW32305 | 1394A PCI PHY/Link Open Host Controller Interface |
| FW352 | |
| FW501 | TRANSISTOR | MOSFET | N-CHANNEL | 30V V(BR)DSS | 7A I(D) | SO |
| FW801A | Low-Power PHY IEEE 1394A-2000 One-Cable Transceiver/Arbiter Device |
| FW801A-DB | Low-Power PHY IEEE 1394A-2000 One-Cable Transceiver/Arbiter Device |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| FW32305 | 制造商:AGERE 制造商全稱:AGERE 功能描述:1394A PCI PHY/Link Open Host Controller Interface |
| FW32306 | 制造商:AGERE 制造商全稱:AGERE 功能描述:PCI PHY/Link Open Host Controller Interface |
| FW323061394 | 制造商:AGERE 制造商全稱:AGERE 功能描述:PCI PHY/Link Open Host Controller Interface |
| FW323061394A | 制造商:AGERE 制造商全稱:AGERE 功能描述:PCI PHY/Link Open Host Controller Interface |
| FW-33-01-G-D-200-065 | 制造商:Samtec Inc 功能描述:CONN BD STACKER HDR 66 POS 1.27MM SLDR ST TH - Bulk |
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