參數(shù)資料
型號(hào): DTMFDECODER-RD
廠商: Silicon Laboratories Inc
文件頁(yè)數(shù): 132/178頁(yè)
文件大小: 0K
描述: KIT REF DESIGN DTMF DECODER
應(yīng)用說(shuō)明: DTMF Decoder Ref Design AppNote
標(biāo)準(zhǔn)包裝: 1
主要目的: 電信,DTMF 解碼器
嵌入式:
已用 IC / 零件: C8051F300
主要屬性: 8kHz 采樣速率模數(shù)轉(zhuǎn)換器
次要屬性: 16 個(gè) Goertzel 濾波器
已供物品: 板,軟件
產(chǎn)品目錄頁(yè)面: 627 (CN2011-ZH PDF)
相關(guān)產(chǎn)品: 336-1535-5-ND - IC 8051 MCU 8K FLASH 14-SOIC
C8051F300-GMR-ND - IC 8051 MCU 8K FLASH 11QFN
336-1245-ND - IC 8051 MCU 8K FLASH 11QFN
其它名稱(chēng): 336-1283
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Rev. 2.9
57
C8051F300/1/2/3/4/5
8.
CIP-51 Microcontroller
The MCU system controller core is the CIP-51 microcontroller. The CIP-51 is fully compatible with the
MCS-51 instruction set; standard 803x/805x assemblers and compilers can be used to develop soft-
ware. The MCU family has a superset of all the peripherals included with a standard 8051. Included are
three 16-bit counter/timers (see description in Section 15), an enhanced full-duplex UART (see description
in Section 14), 256 bytes of internal RAM, 128 byte Special Function Register (SFR) address space (Sec-
tion 8.2.6), and one byte-wide I/O Port (see description in Section 12). The CIP-51 also includes on-chip
debug hardware (see description in Section 17), and interfaces directly with the analog and digital subsys-
tems providing a complete data acquisition or control-system solution in a single integrated circuit.
The CIP-51 Microcontroller core implements the standard 8051 organization and peripherals as well as
additional custom peripherals and functions to extend its capability (see Figure 8.1 for a block diagram).
The CIP-51 includes the following features:
DATA BUS
TMP1
TMP2
PRGM. ADDRESS REG.
PC INCREMENTER
ALU
PSW
DATA BUS
DA
T
A
BU
S
MEMORY
INTERFACE
MEM_ADDRESS
D8
PIPELINE
BUFFER
DATA POINTER
INTERRUPT
INTERFACE
SYSTEM_IRQs
EMULATION_IRQ
MEM_CONTROL
CONTROL
LOGIC
A16
PROGRAM COUNTER (PC)
STOP
CLOCK
RESET
IDLE
POWER CONTROL
REGISTER
DATA
BU
S
SFR
BUS
INTERFACE
SFR_ADDRESS
SFR_CONTROL
SFR_WRITE_DATA
SFR_READ_DATA
D8
B REGISTER
D8
ACCUMULATOR
D8
MEM_WRITE_DATA
MEM_READ_DATA
D8
SRAM
ADDRESS
REGISTER
SRAM
(256 X 8)
D8
STACK POINTER
D8
Figure 8.1. CIP-51 Block Diagram
- Fully Compatible with MCS-51 Instruction Set
- Extended Interrupt Handler
- 25 MIPS Peak Throughput with 25 MHz Clock
- Reset Input
- 0 to 25 MHz Clock Frequency
- Power Management Modes
- 256 Bytes of Internal RAM
- On-chip Debug Logic
- Byte-Wide I/O Port
- Program and Data Memory Security
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PDF描述
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參數(shù)描述
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