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參數(shù)資料
| 型號(hào)： | DSP1629 |
| 英文描述： | TVS 400W 64V UNIDIRECT SMA |
| 中文描述： | DSP1629數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 50/126頁(yè) |
| 文件大?。?/td> | 1993K |
| 代理商： | DSP1629 |
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Data Sheet
March 2000
DSP1629 Digital Signal Processor
50
Lucent Technologies Inc.
5 Software Architecture
(continued)
*
JINT is a JTAG interrupt and is controlled by the HDS. It may be made unmaskable by the Lucent Technologies development system tools.
Encoding: A 0 disables an interrupt; a 1 enables an interrupt.
Encoding: A 0 indicates no interrupt. A 1 indicates an interrupt has been recognized and is pending or being ser-
viced. If a 1 is written to bits 4, 5, or 8 of ins, the corresponding interrupt is cleared.
Table 28. Parallel Host Interface Control (phifc) Register
Bit
15—7
6
Field
RSVD
PSOBEF
5
4
3
2
1
0
PFLAGSEL
PFLAG
PBSELF
PSTRB
PSTROBE
PMODE
Field
PMODE
Value
0
1
0
1
0
1
0
1
Description
8-bit data transfers.
16-bit data transfers.
Intel protocol: PIDS and PODS data strobes.
Motorolaprotocol: PRWN and PDS data strobes.
When PSTROBE = 1, PODS pin (PDS) active-low.
When PSTROBE = 1, PODS pin (PDS) active-high.
In either mode, PBSEL pin = 0
→
pdx0 low byte. See Table 7.
If PMODE = 0, PBSEL pin = 1
→
pdx0 low byte.
If PMODE = 1, PBSEL pin = 0
→
pdx0 high byte.
PIBF and POBE pins active-high.
PIBF and POBE pins active-low.
Normal.
PIBF flag ORed with POBE flag and output on PIBF pin; POBE pin un-
changed (output buffer empty).
Normal.
POBE flag as read through PSTAT register is active-low.
PSTROBE
PSTRB
PBSELF
PFLAG
0
1
0
1
PFLAGSEL
PSOBEF
0
1
Table 29. Interrupt Control (inc) Register
Bit
15
Field
JINT*
14—11
RSVD
10
9
8
7—6
RSVD
5—4
INT[1:0]
3
2
1
0
OBE2
IBF2
TIME
PIBF
POBE
OBE
IBF
Table 30. Interrupt Status (ins) Register
Bit
15
14—11
Field
JINT
RSVD
10
9
8
7—6
RSVD
5—4
INT[1:0]
3
2
1
0
OBE2
IBF2
TIME
PIBF
POBE
OBE
IBF
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