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參數(shù)資料
| 型號： | AM79C940JCW |
| 廠商： | Advanced Micro Devices, Inc. |
| 英文描述： | Media Access Controller for Ethernet (MACE) |
| 中文描述： | 媒體訪問控制器（MACE發(fā)生以太網(wǎng)） |
| 文件頁數(shù)： | 102/122頁 |
| 文件大?。?/td> | 914K |
| 代理商： | AM79C940JCW |
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AMD
102
Am79C940
AC WAVEFORMS
16235C-28
34
Word N
Word N+1
Last Byte
or Word
41
32
42
31
S3
S2
S1
S0
TH
TL
S0
S2
S1
S3
S1
S0
W1
W0
W1
W0
S2
S3
S0
W1
W0
SCLK
(EDSEL = 1)
R/
W
DTV
EOF
DBUS[15:0]
ADD[4:0]
BE0-1
TC
= 0
33
48
49
37
34
43
38
S3
S2
S1
S0
TH
TL
S0
S2
S1
S3
S1
S0
W1
W0
W1
W0
S2
S3
S0
W1
W0
SCLK
(EDSEL = 0)
CS
Host System Interface—3-Cycle Transmit FIFO/Register Write Timing
16235C-29
EOF
RDTREQ
39
44
SCLK
(EDSEL = 1)
S0
S2
S1
S3
S2
S1
S0
S2
S1
S3
S0
S0
S3
S2
45
Note 1
40
SCLK
(EDSEL = 0)
S0
S2
S1
S3
S2
S1
S0
S2
S1
S3
S0
S0
S3
S2
Note:
Once the host detects the
EOF
output active from the MACE device (S2/S3 edge), if no other receive packet exists in
the RCVFIFO which meets the assert conditions for
RDTREQ
, the MACE device will deassert
RDTREQ
within 4 SCLK cycles
(S0/S1 edge). This is consistent for both 2 or 3 cycle read operations.
Host System Interface—
RDTREQ
Read Timing
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AM79C940KCW | Media Access Controller for Ethernet (MACE) |
| AM79C960 | PCnetTM-ISA Single-Chip Ethernet Controller |
| AM79C960KC | PCnetTM-ISA Single-Chip Ethernet Controller |
| AM79C960KCW | PCnetTM-ISA Single-Chip Ethernet Controller |
| AM79C961AKCW | PCnet ⑩-ISA II Jumperless, Full Duplex Single-Chip Ethernet Controller for ISA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AM79C940JI | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LAN Node Controller |
| AM79C940JI/W | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Media Access Controller for Ethernet (MACE⑩) |
| AM79C940KC | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:LAN Node Controller |
| AM79C940KC/W | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Media Access Controller for Ethernet (MACE⑩) |
| AM79C940KCW | 制造商:AMD 制造商全稱:Advanced Micro Devices 功能描述:Media Access Controller for Ethernet (MACE) |
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