參數(shù)資料
型號： ADSP-21267
廠商： Analog Devices, Inc.
英文描述： Preliminary Technical Data
中文描述： 初步技術數(shù)據(jù)
文件頁數(shù)： 25/44頁
文件大?。?/td> 454K
代理商： ADSP-21267
ADSP-21267
Rev. PrA
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January 2004
PRELIMINARY TECHNICAL DATA
Table 19. 16-bit Memory Read Cycle
Parameter
Timing Requirements
t
DRS
t
DRH
Min
Max
Unit
Address/Data [15:0] Setup Before RD high
Address/Data [15:0] Hold After RD high
3.3
0
ns
ns
Switching Characteristics
t
ALEW
t
ALERW
t
ADAS
t
ADAH
t
ALEHZ
t
RW
D = (Data Cycle Duration) x t
CCLK
H = t
CCLK
(if a hold cycle is specified, else H = 0)
ns
ns
ns
ns
ns
ns
ns
ALE Pulse Width
ALE Deasserted to Read/Write Asserted
Address/Data [15:0] Setup Before ALE Deasserted
1
Address/Data [15:0] Hold After ALE Deaserted
1
ALE Deasserted
1
to Address/Data[15:0] In High Z
RD Pulse Width
2 x t
CCLK
– 2
1 x t
CCLK
– 1
2.5 x t
CCLK
– 2.0
0.5 x t
CCLK
– 0.8
0.5 x t
CCLK
– 0.8
D – 2
0.5t
CCLK
+ 3.0
1
On reset, ALE is an active high cycle. However, it can be reconfigured by software to be active low.
Figure 18. Read Cycle For 16-bit Memory Timing
VALID ADDRESS
VALID DATA
t
ADAS
t
ADAH
AD[15:0]
t
ALEHZ
t
DRS
t
DRH
t
ALEW
ALE
RD
t
RW
WR
t
ALERW
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PDF描述
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