參數(shù)資料
型號(hào)： 7540
英文描述： 250MA CMOS LDO, ISUPPLY 1UA & 2% VOUT ACCURACY, -40C to +125C, 3-SOT-89, T/R
中文描述： 7540群用戶(hù)手冊(cè)數(shù)據(jù)4267K/MAY.28.03
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代理商： 7540
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7540 Group User’s Manual
3-75
APPENDIX
3.3.3 Notes on Timer
When n (0 to 255) is written to a timer latch, the frequency division ratio is 1/(n+1).
When a count source of timer X, timer Y or timer Z is switched, stop a count of timer X.
3.3.4 Notes on Timer A
Notes on using timer A are described below.
(1) Common to all modes
When reading timer A (high-order) (TAH) and timer A (low-order) (TAL), the contents of timer A
is read out. Read both registers in order of TAH and TAL following, certainly.
TAH and TAL keep the values until they are read out.
Also, do not write to them during read. In this case, unexpected operation may occur.
When writing data to TAL and TAH even when timer A is operating or stopped, the data are set
to timer A and timer A latch simultaneously. Write both registers in order of TAL and TAH following,
certainly.
Also, do not read them during write. In this case, unexpected operation may occur.
(2) Period measurement mode, event counter mode, and pulse width HL continuously measurement mode
In order to use CNTR
1
pin, set “0” to bit 0 of the port P0 direction register (input mode).
In order to use CNTR
1
pin, set “1” to bit 7 of the interrupt control register to disable the P0
0
key-
on wakeup function.
CNTR
1
interrupt active edge depends on the CNTR
1
active edge switch bit. When this bit is “0”,
the CNTR
1
interrupt request bit is set to “1” at the falling edge of the CNTR
1
pin input signal. When
this bit is “1”, the CNTR
1
interrupt request bit is set to “1” at the rising edge of the CNTR
1
pin input
signal.
However, in the pulse width HL continuously measurement mode, CNTR
1
interrupt request is
generated at both rising and falling edges of CNTR
1
pin input signal regardless of the setting of
CNTR
1
active edge switch bit.
3.3.5 Notes on timer 1
Note on timer 1 is described below.
(1) Notes on set of the oscillation stabilizing time
Timer 1 can be used to set the oscillation stabilizing time after release of the
STP
instruction. The
oscillation stabilizing time after release of STP instruction can be selected from “set automatically”/
“not set automatically” by the oscillation stabilizing time set bit after release of the
STP
instruction
of MISRG. When “0” is set to this bit, “01
16
” is set to timer 1 and “FF
16
” is set to prescaler 1
automatically. When “1” is set to this bit, nothing is set to timer 1 and prescaler 1. Therefore, set the
wait time according to the oscillation stabilizing time of the oscillation. Also, when timer 1 is used,
set values again to timer 1 and prescaler 1 after system is returned from the stop mode.
3.3 Notes on use
相關(guān)PDF資料
PDF描述
7542 250mA CMOS LDO, lsupply 1uA and 2% Vout Accuracy, -40C to +125C, 3-SOT-23, T/R
7544 3.3V LDO POSITVE VOLTAGE REGULATOR 2% TOL.
75450PC Peripheral IC
D122D Converter IC
D347D Logic IC
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
7540_M 制造商:RENESAS 制造商全稱(chēng):Renesas Technology Corp 功能描述:8-BIT CISC SINGLE-CHIP MICROCOMPUTER 740 FAMILY / 740 SERIES
75400 制造商:Honeywell Sensing and Control 功能描述:
7-5-4004 功能描述:3M 4004 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4004 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1
7-5-4008 功能描述:3M 4008 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4008 零件狀態(tài):在售 標(biāo)準(zhǔn)包裝:1
754010 制造商: 功能描述: 制造商:undefined 功能描述:
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