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參數(shù)資料
| 型號： | 7540 |
| 英文描述： | 250MA CMOS LDO, ISUPPLY 1UA & 2% VOUT ACCURACY, -40C to +125C, 3-SOT-89, T/R |
| 中文描述： | 7540群用戶手冊數(shù)據(jù)4267K/MAY.28.03 |
| 文件頁數(shù)： | 148/365頁 |
| 文件大小： | 4267K |
| 代理商： | 7540 |
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7540 Group User’s Manual
APPLICATION
2-73
2.5 Timer Y and timer Z
2.5.3 Timer mode (timer Y and timer Z)
The basic operation of Timer Y and Timer Z are the same. In this section, Timer Y is explained.
(1) Operation description
Prescaler Y counts the count source selected by the timer Y count source selection bits. Each time
the count clock is input, the contents of Prescaler Y is decremented by 1.
When the contents of Prescaler Y reach “00
16
”, an underflow occurs at the next count clock, and the
prescaler Y latch is reloaded into Prescaler Y and count continues. The division ratio of Prescaler
Y is 1/(n+1) provided that the value of Prescaler Y is n.
The contents of Timer Y is decremented by 1 each time the underflow signal of Prescaler Y is input.
When the contents of Timer Y reach “00
16
”, an underflow occurs at the next count clock, and the
timer Y primary latch is reloaded into Timer Y and count continues.
(In the timer mode, the contents of timer Y primary latch is counted. Timer Y secondary latch is not
used in this mode.)
The division ratio of Timer Y is 1/(m+1) provided that the value of Timer Y is m. Accordingly, the
division ratio of Prescaler Y and Timer Y is provided as follows that the value of Prescaler Y is n
and the value of Timer Y is m.
In the timer mode, writing to “l(fā)atch only” or “l(fā)atches and Prescaler Y and timer Y primary” can be
selected by the setting value of the timer Y write control bit.
Timer Y can stop counting by setting “1” to the timer Y count stop bit.
Also, when timer Y underflows, the timer Y interrupt request bit is set to “1”.
Timer Y reloads the value of latch when counting is stopped by the timer count stop bit.
(When timer is read out while timer is stopped, the value of latch is read. The value of timer can be
read out only while timer is operating.)
(2) Timer mode setting method
Figure 2.5.19 shows the setting method for timer mode of Timer Y.
When Timer Z is used, registers are set by the same method.
Division ratio =
1
(n+1)
(m+1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 7542 | 250mA CMOS LDO, lsupply 1uA and 2% Vout Accuracy, -40C to +125C, 3-SOT-23, T/R |
| 7544 | 3.3V LDO POSITVE VOLTAGE REGULATOR 2% TOL. |
| 75450PC | Peripheral IC |
| D122D | Converter IC |
| D347D | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 7540_M | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:8-BIT CISC SINGLE-CHIP MICROCOMPUTER 740 FAMILY / 740 SERIES |
| 75400 | 制造商:Honeywell Sensing and Control 功能描述: |
| 7-5-4004 | 功能描述:3M 4004 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4004 零件狀態(tài):在售 標準包裝:1 |
| 7-5-4008 | 功能描述:3M 4008 DOUBLE COATED URETHANE F 制造商:3m (tc) 系列:4008 零件狀態(tài):在售 標準包裝:1 |
| 754010 | 制造商: 功能描述: 制造商:undefined 功能描述: |
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