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參數(shù)資料
| 型號： | 403GC-3BA25C1 |
| 元件分類： | 復(fù)位半導(dǎo)體 |
| 英文描述： | 300mA LDO Linear Regulators with Internal Microprocessor Reset Circuit |
| 中文描述： | 32位微處理器 |
| 文件頁數(shù)： | 44/48頁 |
| 文件大?。?/td> | 768K |
| 代理商： | 403GC-3BA25C1 |
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IBM PowerPC 403GC
44
External Master Nonburst DRAM Read with HoldReq/HoldAck
Bank Register Bit Settings
Notes:
1. XReq, XSize0, XSize1, and XAck are multiplexed with DMAR3, EOT3/TC3, OE, and DMAA3, respectively.
2. A4, A5, A30, and A31 are multiplexed with WBE0, WBE1, WBE2, and WBE3, respectively.
SLF
ERM
Bus
Width
Ext
Mux
RAS-to-
CAS
Refresh
Mode
Page
Mode
First
Access
Burst
Access
Prechg
Cycles
Refresh
RAS
Refresh
Rate
Bit 13 Bit 14
Bits
15:16
Bit 17
Bit 18
Bit 19
Bit 20
Bits
21:22
Bits
23:24
Bit 25
Bit 26
Bits
27:30
0 or 1
0
10
1
0
0
0
01
xx
0
x
xxxx
SysClk
R/W
RASx
CAS0:3
DRAMOE
DRAMWE
D0:31
1
2
3
4
5
6
7
8
9
10
11
12
AMuxCAS
RAS
CAS
Pre-
Charge
CAS
HoldReq
HoldAck
XSize0:1
1
XReq
BSel
Ext Bus Master
DRAM Control
10
Valid Address - Ext Master
403 Address
403 Data
HiZ
HiZ
403 Master
403 Master
driDRAM
A4:31
2
XReq
1
XAck
1
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 403GC-3BA33C1 | 300mA LDO Linear Regulators with Internal Microprocessor Reset Circuit |
| 403GC-3BA40C1 | 300mA LDO Linear Regulators with Internal Microprocessor Reset Circuit |
| 403GCX-3BC50C2 | 300mA LDO Linear Regulators with Internal Microprocessor Reset Circuit |
| 403GCX-3BC66C2 | 32-Bit Microprocessor |
| 403GCX-3BC80C2 | 300mA LDO Linear Regulators with Internal Microprocessor Reset Circuit |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 403GC-3BA33C1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| 403GC-3BA40C1 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| 403GCX2JC66C2 | 制造商:IBM 功能描述:38R2233 |
| 403GCX-3BC50C2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
| 403GCX-3BC66C2 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:32-Bit Microprocessor |
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