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參數(shù)資料
| 型號： | XRT72L50IQ |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 52/471頁 |
| 文件大?。?/td> | 2424K |
| 代理商： | XRT72L50IQ |
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XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER WITH HDLC CONTROLLER
REV. 1.2.1
á
39
7.
After some settling time, the data on the bi-directional data bus will stabilize and can be read by the μC/μP
The XRT72L50 DS3/E3 Framer will indicate that this data can be read by toggling the RDY_DTCK
(READY) signal "Low".
8.
After the μC/μP detects the RDY_DTCK signal, it can then terminate the Read Cycle by toggling the
RD_DS
(Read Strobe) input pin "High".
Figure 23
presents a timing diagram which illustrates the behavior of the Microprocessor Interface signals
during an Intel-type Programmed I/O Read Operation.
The Intel Mode Write Cycle
Whenever an Intel-type μC/μP wishes to write a byte or word of data into a register or buffer location, it should
do the following.
1.
Place the address of the target register or buffer location on the Address Bus input pins, A[8:0].
2.
While the μC/μP is placing this address value onto the Address Bus, the Address Decoding circuitry (within
the user's system) should assert the CS input pin of the Framer by toggling it "Low". This enables further
communication between the μC/μP and the Framer Microprocessor Interface block.
3.
Assert the ALE_AS input pin by toggling it "High". When the μC/μP asserts the ALE_AS input pin, it
enables the Address Bus Input Drivers within the Framer chip.
4.
After allowing the data on the Address Bus pins to settle (by waiting the appropriate Address Setup time),
the μC/μP should toggle the ALE_AS input pin "Low". This step causes the Framer to latch the contents of
the Address Bus into its internal circuitry. At this point, the address of the register or buffer location has
now been selected.
5.
The μC/μP should then place the byte or word that it intends to write into the target register, on the bi-direc-
tional data bus, D[7:0].
6.
Next, the μC/μP should indicate that this current bus cycle is a Write Operation by toggling the
WR_R/W
(Write Strobe) input pin "Low". This action also enables the bi-directional data bus input drivers of the
Framer.
7.
After some amount of time when the data on the bi-directional data bus to settles, the RDY will go “l(fā)ow indi-
cating that data has been written to its destination, the μC/μP will toggle the
WR_R/W
(Write Strobe) input
pin "High", which terminates the write cycle.
8.
Figure 24
presents a timing diagram which illustrates the behavior of the Microprocessor Interface signals
during an Intel-type Programmed I/O Write Operation.
F
IGURE
23. M
ICROPROCESSOR
I
NTERFACE
T
IMING
- I
NTEL
-
TYPE
P
ROGRAMMED
I/O R
EAD
O
PERATION
Not Valid
Valid
Address of Target Register
ALE_AS
A[8:0]
CS
D[7:0]
RD_DS
W R_R/W
RDY_DTCK
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT72L50 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52IQ | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L54 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT72L50IQ-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L50IQTR-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52 | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
| XRT72L52ES-PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52IQ | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
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