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參數(shù)資料
| 型號： | XRT72L50IQ |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 160/471頁 |
| 文件大?。?/td> | 2424K |
| 代理商： | XRT72L50IQ |
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XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER WITH HDLC CONTROLLER
REV. 1.2.1
á
147
Nominally, the Transmit Section within the XRT72L50 generates a TxNibClk pulse for every 4 RxOutClk or
TxInClk periods. However, in 14 cases within a DS3 frame period, the Transmit Payload Data Input Interface
allows 5 TxInClk periods to occur between two consecutive TxNibClk pulses.
Interfacing the Transmit Payload Data Input Interface block of the XRT72L50 to the Terminal Equipment
for Mode 5 Operation
This is illustrated in
Figure 40
Mode 5 Operation of the Terminal Equipment
In
Figure 40
, both the Terminal Equipment and the XRT72L50 is driven by an external 11.184MHz clock signal.
The Terminal Equipment receives the 11.184MHz clock signal via the DS3_Nib_Clock_In input pin. The
XRT72L50 outputs the 11.184MHz clock signal via the TxNibClk output pin.
The Terminal Equipment serially outputs the data on the DS3_Data_Out[3:0] pins upon the rising edge of the
signal at the DS3_Clock_In input pin. The DS3_Data_Out[3:0] output pins of the Terminal Equipment is
electrically connected to the TxNib[3:0] input pins.
The XRT72L50 latches the data residing on the TxNib[3:0] input pins on the rising edge of the TxNibClk signal.
In this case, the Terminal Equipment has the responsibility of providing the framing reference signal by pulsing
the Tx_Start_of_Frame output pin and in turn, the TxFrameRef input pin of the XRT72L50 "High" for one bit-
period coincident with the first nibble of a new DS3 frame. Once the XRT72L50 detects the rising edge of the
input at its TxFrameRef input pin, it begins generation of a new DS3 frame.
Finally, the XRT72L50 always internally generates the Overhead bits when it is operating in both the DS3 and
Nibble-parallel modes. The XRT72L50 pulls the TxOHInd input pin "Low".
The behavior of the signals between the XRT72L50 and the Terminal Equipment for DS3 Mode 5 Operation is
illustrated in
Figure 41
.
F
IGURE
40. T
HE
T
ERMINAL
E
QUIPMENT
BEING
INTERFACED
TO
THE
T
RANSMIT
P
AYLOAD
D
ATA
I
NPUT
I
NTERFACE
BLOCK
FOR
M
ODE
5 (N
IBBLE
-P
ARALLEL
/L
OCAL
-T
IMED
/F
RAME
-S
LAVE
) O
PERATION
DS3_Nib_Clock_In
DS3_Data_Out[3:0]
Tx_Start_of_Frame
TxInClk
TxNibClk
TxNib[3:0]
TxFrameRef
NibIntf
Terminal Equipment
DS3 Framer
11.184MHz
4
VCC
44.736MHz
Clock Source
相關PDF資料 |
PDF描述 |
|---|---|
| XRT72L50 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52IQ | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L54 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XRT72L50IQ-F | 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L50IQTR-F | 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52 | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
| XRT72L52ES-PCI | 功能描述:網(wǎng)絡控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52IQ | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
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