參數(shù)資料
型號: XC56L307VF160
廠商: Freescale Semiconductor
文件頁數(shù): 30/104頁
文件大小: 0K
描述: IC DSP 24BIT FIXED POINT 196-BGA
標準包裝: 126
系列: DSP563xx
類型: 定點
接口: 主機接口,SSI,SCI
時鐘速率: 160MHz
非易失內(nèi)存: ROM(576 B)
芯片上RAM: 576kB
電壓 - 輸入/輸出: 3.30V
電壓 - 核心: 1.80V
安裝類型: 表面貼裝
封裝/外殼: 196-LBGA
供應商設備封裝: 196-MAPBGA(15x15)
包裝: 托盤
AC Electrical Characteristics
DSP56L307 Technical Data, Rev. 6
Freescale Semiconductor
2-11
2.4.5
External Memory Expansion Port (Port A)
2.4.5.1 SRAM Timing
Figure 2-9.
External Memory Access (DMA Source) Timing
Table 2-8.
100 MHz SRAM Timing
No.
Characteristics
Symbol
Expression1
100 MHz
Unit
Min
Max
100
Address valid and AA assertion pulse width2
tRC, tWC
2
× TC 4.0
[WS = 1]
(WS + 2)
× T
C 4.0
[2
≤WS ≤7]
(WS + 3)
× TC 4.0
[WS
≥ 8]
16.0
36.0
106.0
ns
101
Address and AA valid to WR assertion
tAS
0.25
× TC 2.4
[WS = 1]
0.75
× T
C 3.0
[2
≤WS ≤3]
1.25
× TC 3.0
[WS
≥ 4]
0.1
4.5
9.5
ns
102
WR assertion pulse width
tWP
1.5
× TC 4.5
[WS = 1]
WS
× T
C 4.0
[2
≤WS ≤3]
(WS
0.5) × TC 4.0
[WS
≥ 4]
10.5
16.0
31.0
ns
103
WR deassertion to address not valid
tWR
0.25
× TC 2.4
[WS = 1]
1.25
× T
C 4.0
[2
≤WS ≤7]
2.25
× TC 4.0
[WS
≥ 8]
0.1
8.5
18.5
ns
104
Address and AA valid to input data valid
tAA, tAC
(WS + 0.75)
× TC 6.5
[WS
≥ 1]
—11.0
ns
105
RD assertion to input data valid
tOE
(WS + 0.25)
× T
C 6.5
[WS
≥ 1]
—6.0
ns
106
RD deassertion to data not valid (data hold time)
tOHZ
0.0
ns
107
Address valid to WR deassertion2
tAW
(WS + 0.75)
× T
C 4.0
[WS
≥ 1]
13.5
ns
29
DMA Source Address
First Interrupt Instruction Execution
A[0–17]
RD
WR
IRQA, IRQB,
IRQC, IRQD,
NMI
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PDF描述
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