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參數(shù)資料
| 型號(hào)： | W83977TF(EOL) |
| 英文描述： | W83877TF plus KBC. CIR. RTC |
| 中文描述： | W83877TF加比聯(lián)。稅務(wù)局局長。時(shí)鐘 |
| 文件頁數(shù)： | 70/161頁 |
| 文件大?。?/td> | 592K |
| 代理商： | W83977TF(EOL) |
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W83977EF/ CTF
PRELIMINARY
Publication Release Date: March 1999
-61 -
Revision A1
4.2.10 Bank1.Reg2 - Version ID Regiister I (VID)
Power on default <7:0> = 0001,0000 binary
Bit
Name
Read/Write
Description
7-0
VID
Read Only
Version ID, default is set to 0x10.
4.2.11 Bank0~3.Reg3 - CIR Control Register 0/Bank Select Register (CTR0/BSR)
(BANK0~3)
This register is defined same as in Bank0.Reg3.
4.2.12 Bank1.Reg4 - Timer Low Byte Register (TMRL)
Power on default <7:0> = 0000,0000 binary
Bit
Name
Read/Write
Description
7-0
TMRL
Read/Write
Timer Low Byte Register. This is a 12-bit timer (another
4-bit is defined in Bank1.Reg5) for which resolution is 1
ms, that is, the programmed maximum time is 2
12
-1
ms. The timer is a down-counter. The timer starts down
count when the bit EN_TMR (Enable Timer) of
Bank0.Reg2. is set to 1. When the timer down counts to
zero
and EN_TMR=1, the TMR_I is set to 1. When the
counter down counts to zero, a new initial value will be
re-loaded into the timer counter.
4.2.13 Bank1.Reg5 - Timer High Byte Register (TMRH)
Power on default <7:0> = 0000,0000 binary
Bit
Name
Read/Write
Description
7-4
Reserved
Reserved.
3-0
TMRH
Read/Write
Timer High Byte Register. See Bank1.Reg4.
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PDF描述 |
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