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參數(shù)資料
| 型號(hào)： | UPD61051 |
| 廠商： | NEC Corp. |
| 英文描述： | MOS INTEGRATED CIRCUIT MPEG2 AUDIO/VIDEO ENCODER |
| 中文描述： | 馬鞍山集成電路MPEG2音頻/視頻編碼器 |
| 文件頁(yè)數(shù)： | 53/106頁(yè) |
| 文件大?。?/td> | 824K |
| 代理商： | UPD61051 |
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Data Sheet S15082EJ4V0DS
53
μ
PD61051, 61052
4.2.2
External ROM to instruction RAM of internal CPU
When the host CPU is a serial bus type, CPU transmits the instruction of a mode from external ROM to instruction
RAM of Internal CPU.
When transferring data continuously, transfer during resetting an internal CPU, If reset of internal CPU is can
canceled on the way, the internal CPU sometime malfunction.
External ROM
to instruction RAM
of internal CPU
Internal CPU reset
Reset register (3EH)
←
02H setting
Destination address register
(24H to 26H) setting
Source address register
(21H to 23H) setting
ROM access cycle register
(35H) setting
(Program size + 3)/4
Transfer counter register
(27H to 29H) setting
iROM
→
iRAM transfer
Transfer mode register
(20H)
←
80H setting
Return
Transfer ending (refer to
4.7
)
Internal CPU reset is canceled
Reset register
(3EH)
←
00H setting
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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