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參數(shù)資料
| 型號： | UPD44647094F5-E30-FQ1 |
| 元件分類： | SRAM |
| 英文描述： | 8M X 9 QDR SRAM, 0.45 ns, PBGA165 |
| 封裝： | 15 X 17 MM, PLASTIC, BGA-165 |
| 文件頁數(shù)： | 32/36頁 |
| 文件大?。?/td> | 479K |
| 代理商： | UPD44647094F5-E30-FQ1 |
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5
Preliminary Data Sheet M18526EJ1V0DS
μPD44647094,44647184,44647364, 44647096,44647186,44647366
Pin Configurations
165-pin PLASTIC BGA (15x17)
(Top View)
[
μPD44647094], [μPD44647096]
8M x 9-bit
1
2
3
4
5
6
7
8
9
10
11
A
CQ#
A
W#
NC
K#
NC/144M
R#
A
CQ
B
NC
A
NC/288M
K
BW0#
A
NC
Q4
C
NC
VSS
A
NC
A
VSS
NC
D4
D
NC
D5
NC
VSS
NC
E
NC
Q5
VDDQ
VSS
VDDQ
NC
D3
Q3
F
NC
VDDQ
VDD
VSS
VDD
VDDQ
NC
G
NC
D6
Q6
VDDQ
VDD
VSS
VDD
VDDQ
NC
H
DLL#
VREF
VDDQ
VDD
VSS
VDD
VDDQ
VREF
ZQ
J
NC
VDDQ
VDD
VSS
VDD
VDDQ
NC
Q2
D2
K
NC
VDDQ
VDD
VSS
VDD
VDDQ
NC
L
NC
Q7
D7
VDDQ
VSS
VDDQ
NC
Q1
M
NC
VSS
NC
D1
N
NC
D8
NC
VSS
A
VSS
NC
P
NC
Q8
A
QVLD
A
NC
D0
Q0
R
TDO
TCK
A
NC
A
TMS
TDI
A
: Address inputs
TMS
: IEEE 1149.1 Test input
D0 to D8
: Data inputs
TDI
: IEEE 1149.1 Test input
Q0 to Q8
: Data outputs
TCK
: IEEE 1149.1 Clock input
R#
: Read input
TDO
: IEEE 1149.1 Test output
W#
: Write input
VREF
: HSTL input reference input
BW0#
: Byte Write data select
VDD
: Power Supply
K, K#
: Input clock
VDDQ
: Power Supply
CQ, CQ#
: Echo clock
VSS
: Ground
ZQ
: Output impedance matching
NC
: No connection
DLL#
: DLL/PLL disable
NC/xxM
: Expansion address for xxMb
QVLD
: Q Valid output
Remarks 1.
×××# indicates active LOW signal.
2. Refer to Package Drawing for the index mark.
3. 7A and 5B are expansion addresses: 7A for 144Mb and 5B for 288Mb.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| UPD4502161G5-A12-7JF | x16 SDRAM |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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