Tables
13
July 2002 Revised March 2004
SPRS200E
List of Tables
Table
Page
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Characteristics of the DM642 Processor
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TMS320DM642 Memory Map Summary
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EMIFA Registers
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L2 Cache Registers (C64x)
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Quick DMA (QDMA) and Pseudo Registers
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EDMA Registers (C64x)
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EDMA Parameter RAM (C64x)
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Interrupt Selector Registers (C64x)
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Ethernet MAC (EMAC) Control Registers
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EMAC Statistics Registers
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EMAC Wrapper
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EWRAP Registers
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Device Configuration Registers
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114
McBSP 0 Registers
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115
McBSP 1 Registers
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116
Timer 0 Registers
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117
Timer 1 Registers
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118
Timer 2 Registers
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HPI Registers
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120
GP0 Registers
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PCI Peripheral Registers
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VCXO Interpolated Control (VIC) Port Registers
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123
MDIO Registers
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124
Video Port 0, 1, and 2 (VP0, VP1, and VP2) Control Registers
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125
McASP0 Control Registers
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McASP0 Data Registers
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127
I2C0 Registers
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TMS320DM642 EDMA Channel Synchronization Events
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DM642 DSP Interrupts
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PCI_EN, HD5, and MAC_EN Peripheral Selection (HPI, GP0[15:9], PCI, EMAC, and MDIO)
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HPI vs. EMAC Peripheral Pin Selection
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DM642 Device Configuration Pins (TOUT1/LENDIAN, AEA[22:19], GP0[3]/PCIEEAI,
VDAC/GP0[8]/PCI66, HD5/AD5, PCI_EN, and MAC_EN)
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Peripheral Configuration (PERCFG) Register Selection Bit Descriptions
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PCFGLOCK Register Selection Bit Descriptions Read Accesses
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PCFGLOCK Register Selection Bit Descriptions Write Accesses
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Device Status (DEVSTAT) Register Selection Bit Descriptions
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28
JTAG ID Register Selection Bit Descriptions
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DM642 Device Multiplexed Pins
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Terminal Functions
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TMS320DM642 PLL Multiply Factor Options, Clock Frequency Ranges, and Typical Lock
Time
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212
Characteristics of the Power-Down Modes
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