
Contents
8
July 2002 Revised March 2004
SPRS200E
Section
Page
2.14.11
Power-Supply Sequencing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.14.11.1
Power-Supply Design Considerations
. . . . . . . . . . . . . . . . . . . . . .
2.14.11.2
Power-Supply Decoupling
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.14.12
Peripheral Power-Down Operation
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.14.13
IEEE 1149.1 JTAG Compatibility Statement
. . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.14.14
EMIF Device Speed
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.14.15
Bootmode
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3
Electrical Specifications
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.1
Absolute Maximum Ratings Over Operating Case Temperature Range
. . . . . . . . . . . . . . . . .
3.2
Recommended Operating Conditions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3
Electrical Characteristics Over Recommended Ranges of Supply Voltage and Operating
Case Temperature
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3.4
Recommended Clock and Control Signal Transition Behavior
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4
Parameter Information
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.1
Signal Transition Levels
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.2
Signal Transition Rates
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.3
Timing Parameters and Board Routing Analysis
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5
Peripheral Electrical Specifications
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1
Input and Output Clocks
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.2
Asynchronous Memory Timing
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5.3
Programmable Synchronous Interface Timing
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5.4
Synchronous DRAM Timing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.5
HOLD/HOLDA Timing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.6
BUSREQ Timing
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5.7
Reset Timing
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5.8
External Interrupt Timing
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5.9
Multichannel Audio Serial Port (McASP) Timing
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5.10
Inter-Integrated Circuits (I2C) Timing
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5.11
Host-Port Interface (HPI) Timing
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5.12
Peripheral Component Interconnect (PCI) Timing
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5.13
Multichannel Buffered Serial Port (McBSP) Timing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.14
Video Port Timing (VP0, VP1, VP2)
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5.14.1
VCLKIN timing (Video Capture Mode)
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5.14.2
STCLK Timing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.14.3
Video Data and Control Timing (Video Capture Mode)
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