參數(shù)資料
型號： TMX320DM642GNZ500
廠商： TEXAS INSTRUMENTS INC
元件分類： 數(shù)字信號處理
英文描述： 64-BIT, 75.19 MHz, OTHER DSP, PBGA548
封裝： 27 X 27 MM, 1 MM PITCH, PLASTIC, BGA-548
文件頁數(shù)： 164/181頁
文件大小： 2291K
代理商： TMX320DM642GNZ500
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Terminal Functions
83
July 2002 Revised March 2004
SPRS200E
Table 210. Terminal Functions (Continued)
SIGNAL
DESCRIPTION
IPD/
IPU
TYPE
NAME
DESCRIPTION
IPD/
IPU
TYPE
NO.
EMIFA (64-BIT) ADDRESS
AEA22
U23
AEA21
V24
EMIFA external address (doubleword address)
AEA20
V25
EMIFA external address (doubleword address)
Note: EMIFA address numbering for the DM642 device starts with AEA3 to maintain
AEA19
V26
Note: EMIFA address numbering for the DM642 device starts with AEA3 to maintain
signal name compatibility with other C64x
devices (e.g., C6414, C6415, and C6416)
AEA18
V23
signal name compatibility with other C64x
devices (e.g., C6414, C6415, and C6416)
[see the 64-bit EMIF addressing scheme in the TMS320C6000 DSP External Memory
Interface (EMIF) Reference Guide (literature number SPRU266)].
AEA17
U24
[see the 64-bit EMIF addressing scheme in the TMS320C6000 DSP External Memory
Interface (EMIF) Reference Guide (literature number SPRU266)].
AEA16
U25
Also controls initialization of DSP modes at reset (I) via pullup/pulldown resistors
AEA15
U26
Also controls initialization of DSP modes at reset (I) via pullup/pulldown resistors
Boot mode (AEA[22:21]):
00 –
No boot (default mode)
AEA14
T24
Boot mode (AEA[22:21]):
00 –
No boot (default mode)
01 HPI/PCI boot (based on PCI_EN pin)
AEA13
T25
O/Z
IPD
01 HPI/PCI boot (based on PCI_EN pin)
10 Reserved
AEA12
R23
O/Z
IPD
10 Reserved
11 EMIFA boot
AEA11
R24
11 EMIFA boot
EMIF clock select
AEA10
P23
EMIF clock select
AEA9
P24
AEA[20:19]: Clock mode select for EMIFA (AECLKIN_SEL[1:0])
00 –
AECLKIN (default mode)
AEA8
P26
AEA[20:19]: Clock mode select for EMIFA (AECLKIN_SEL[1:0])
00 –
AECLKIN (default mode)
01 CPU/4 Clock Rate
AEA7
N23
01 CPU/4 Clock Rate
10 CPU/6 Clock Rate
AEA6
N24
10 CPU/6 Clock Rate
11 Reserved
AEA5
N26
For more details, see the Device Configurations section of this data sheet.
AEA4
M23
For more details, see the Device Configurations section of this data sheet.
AEA3
M24
EMIFA (64-BIT) DATA
AED63
AF24
AED62
AF23
AED61
AE23
AED60
AD23
AED59
AD22
AED58
AE22
AED57
AD21
AED56
AE21
AED55
AC21
I/O/Z
IPU
EMIFA external data
AED54
AF21
I/O/Z
IPU
EMIFA external data
AED53
AD20
AED52
AE20
AED51
AC20
AED50
AF20
AED49
AC19
AED48
AD19
AED47
W23
AED46
Y26
I = Input, O = Output, Z = High impedance, S = Supply voltage, GND = Ground
IPD = Internal pulldown, IPU = Internal pullup. (These IPD/IPU signal pins feature a 30-k IPD or IPU resistor. To pull up a signal to the opposite
supply rail, a 1-k
resistor should be used.)
§ These pins are multiplexed pins. For more details, see the Device Configurations section of this data sheet.
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