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參數(shù)資料
| 型號(hào)： | TMUX03155 |
| 英文描述： | TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer |
| 中文描述： | TMUX03155 STS-3/STM-1（非盟- 4）復(fù)用器/解復(fù)用器 |
| 文件頁(yè)數(shù)： | 73/120頁(yè) |
| 文件大?。?/td> | 1542K |
| 代理商： | TMUX03155 |
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Agere Systems Inc.
73
Data Sheet
April 2001
TMUX03155 STS-3/STM-1 (AU-4) Multiplexer/Demultiplexer
Microprocessor Interface
(continued)
Register Map
(continued)
Table 52. Register 77: Transmit High-Speed Error Insert Control Parameters (R/W)
Table 53. Register 78: Transmit High-Speed Error Insert (R/W)
Address
Dec (Hex)
77 (0x4D)
Bit
Name
Function
Reset
Default
0
7
TPFEBEEINS
Transmit Path FEBE Error Insert.
Control bit,
when set to a logic 1, causes a continuous Path
FEBE error in the outgoing STM-1 (AU-4) signal;
otherwise, a normal Path FEBE value is sent.
Transmit Section FEBE Error Insert.
Control bit,
when set to a logic 1, causes a continuous Section
FEBE error in the outgoing STS-3/STM-1 (AU-4)
signal; otherwise, the normal Section FEBE value is
sent.
Transmit APS Babble Insert.
Control bit, when set
to a logic 1, causes an inconsistent APS byte
(K1[7:0], K2[7:3]) to be inserted into the outgoing
STS-3/STM-1 (AU-4) frame.
Transmit Frame Error Insert Value.
These bits
specify the number of consecutive frames to be
inserted with a frame error (A1A2). This register is
used in conjunction with control bit TA1A2ERREN,
0x04.
77 (0x4D)
6
TSFEBEEINS
0
77 (0x4D)
5
TAPSBABLEINS
0
77 (0x4D)
4—0
TA1A2ERRINS[4:0]
0x0
Address
Dec (Hex)
78 (0x4E)
Bit
Name
Function
Reset
Default
000
7—5
TH1H2CRUPEN[3—1]
Transmit H1 H2 Corrupt Enable.
Control bits,
when set to a logic 1, cause the output H1 and H2
bytes of the STS-3/STM-1 (AU-4) signal to be cor-
rupted on a per STS-1 basis. In the AU-4 mode,
only control bit 1 is used.
Transmit H1 H2 Corrupt or NDF.
Control bit, when
set to a logic 0, causes an invalid pointer to be
inserted into the output H1 and H2 bytes; otherwise,
a continuous NDF condition (1001) is sent.
Transmit Test Pattern (2
23
– 1) or (2
15
– 1).
Control
bit, when set to a logic 0, causes a Q23 + Q17 +1
pattern to be inserted; otherwise, generate a
Q15 + Q14 + 1 pattern.
Transmit Test Generation Port Select.
Control
bits specify which TUG-3 the pseudorandom pat-
tern is inserted into: 00 disable, 01 = TUG-3 #1,
10 = TUG-3 #2, 11 = TUG-3 #3.
78 (0x4E)
4
TH1H2CRUPPorNDF
0
78 (0x4E)
2
TPAT23or15
0
78 (0x4E)
1—0
TSTGEN_PSEL[1:0]
00
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| TMV 0505DEN | 制造商:Traco Power 功能描述:TMV 0505DEN |
| TMV 0505EN | 制造商:Traco Power 功能描述:POWER SUPPLY, 5 VDC 200 MA 65 % |
| TMV 0505S | 制造商:Traco Power 功能描述:DC/DC CONVERTERS, 1 WATT, 5 VDC |
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