參數(shù)資料
型號: STP2200ABGA-100
元件分類: 存儲控制器/管理單元
英文描述: 256M X 8, DRAM CONTROLLER, PBGA225
封裝: PLASTIC, BGA-225
文件頁數(shù): 28/36頁
文件大?。?/td> 433K
代理商: STP2200ABGA-100
34
STP2200ABGA
Uniprocessor System Controller
USC
July 1997
PACKAGE INFORMATION
1. DEBUG pins are used for internal debug only and are not used in a system implementation.
225-Pin Plastic Ball Grid Array (ABGA) Pin Assignments
Pin
Signal Name
Pin
Signal Name
Pin
Signal Name
Pin
Signal Name
Pin
Signal Name
A1
VSS
D1
VDD
G1
VSS
K1
DEBUG_2 [1]
N1
MEMADDR_5
A2
UPA_PREPLY1_1
D2
BMX_CMD0_2
G2
WE
K2
MEMADDR_12
N2
MEMADDR_7
A3
JTAG_TRST
D3
UPA_SREPLY0_0
G3
BMX_CMD1_0
K3
DEBUG_1 [1]
N3
MEMADDR_1
A4
VDD
D4
UPA_PREPLY1_4
G4
CAS2
K4
MEMADDR_10
N4
A5
JTAG_TDI
D5
UPA_PREPLY1_0
G5
VDD
K5
MEMADDR_4
N5
UPA_ADDRBUS0_31
A6
X_RESET
D6
PLL_BYPASS
G6
VSS
K6
UPA_ADR0_PAR0
N6
UPA_ADDRBUS0_24
A7
VSS
D7
CLK+
G7
VSS
K7
VSS
N7
UPA_ADDRBUS0_21
A8
PLL_VDD
D8
UPA_ECC_VAL_0
G8
VSS
K8
VSS
N8
UPA_ADDRBUS0_18
A9
VDD
D9
UPA_SREPLY1_1
G9
VSS
K9
VSS
N9
UPA_ADDRBUS0_17
A10
UPA_SREPLY1_2
D10
EBUS_RDY
G10
VSS
K10
UPA_ADDRBUS0_00
N10
UPA_ADDRBUS0_10
A11
UPA_SREPLY1_0
D11
EBUS_DATA_4
G11
VDD
K11
UPA_ADDRBUS1_27
N11
UPA_ADDRBUS0_06
A12
VSS
D12
EBUS_ADDR_0
G12
UPA_ADDRBUS1_05
K12
UPA_ADDRBUS1_19
N12
UPA_ADDRBUS0_05
A13
EBUS_RD
D13
UPA_ADDR1_VAL1
G13
UPA_ADDRBUS1_09
K13
UPA_ADDRBUS1_21
N13
UPA_REQIN0_1
A14
EBUS_DATA_6
D14
5V_REF
G14
UPA_ADDRBUS1_07
K14
UPA_ADDRBUS1_16
N14
UPA_ADDRBUS1_26
A15
VDD
D15
VSS
G15
VDD
K15
UPA_ADDRBUS1_14
N15
UPA_ADDRBUS1_23
B1
UPA_SREPLY0_1
E1
BMX_CMD0_1
H1
CAS0
L1
MEMADDR_11
P1
MEMADDR_2
B2
UPA_SREPLY0_4
E2
BMX_CMD1_1
H2
RAS3
L2
MEMADDR_9
P2
UPA_PREPLY0_4
B3
UPA_SREPLY0_3
E3
BMX_CMD0_3
H3
CAS1
L3
MEMADDR_6
P3
UPA_PREPLY0_3
B4
JTAG_TMS
E4
MRB_CTRL0
H4
DEBUG_0 [1]
L4
MEMADDR_0
P4
UPA_ADDRBUS0_34
B5
JTAG_TDO
E5
UPA_PREPLY1_3
H5
VDD
L5
UPA_PREPLY0_2
P5
UPA_ADDRBUS0_29
B6
UPA_DATA_STALL1
E6
P_RESET
H6
VSS
L6
UPA_ADDRBUS0_33
P6
UPA_ADDRBUS0_28
B7
PLL_VSS
E7
VDD
H7
VSS
L7
VDD
P7
UPA_ADDRBUS0_23
B8
UPA_DATA_STALL0
E8
VDD
H8
VSS
L8
VDD
P8
UPA_ADDRBUS0_20
B9
UPA_SREPLY1_4
E9
VDD
H9
VSS
L9
VDD
P9
UPA_ADDRBUS0_15
B10
UPA_RESET_1
E10
EBUS_CS
H10
VSS
L10
UPA_ADDRBUS0_04
P10
UPA_ADDRBUS0_13
B11
EBUS_WR
E11
EBUS_ADDR_1
H11
VDD
L11
UPA_ADDR0_VAL0_0
P11
UPA_ADDRBUS0_09
B12
UPA_RESET_0
E12
UPA_SREPLY2_1
H12
UPA_ADDRBUS1_13
L12
UPA_ADDRBUS1_22
P12
UPA_ADDRBUS0_07
B13
EBUS_DATA_1
E13
UPA_PREPLY2_1
H13
UPA_ADDRBUS1_12
L13
UPA_ADDRBUS1_24
P13
UPA_ADDRBUS0_01
B14
EBUS_DATA_3
E14
UPA_ADDRBUS1_00
H14
UPA_ADDRBUS1_08
L14
UPA_ADDRBUS1_20
P14
UPA_REQIN0_0
B15
EBUS_DATA_0
E15
UPA_ADDRBUS1_02
H15
UPA_ADDRBUS1_10
L15
UPA_ADDRBUS1_18
P15
UPA_SC_REQ0
C1
BMX_CMD1_3
F1
BMX_CMD0_0
J1
VDD
M1
VSS
R1
VDD
C2
MWB_CTRL0
F2
CAS3
J2
RAS1
M2
MEMADDR_8
R2
UPA_PREPLY0_1
C3
MRB_CTRL1
F3
BMX_CMD1_2
J3
RAS2
M3
MEMADDR_3
R3
UPA_ADDRBUS0_32
C4
UPA_PREPLY1_2
F4
MWB_CTRL1
J4
RAS0
M4
NC
R4
VSS
C5
JTAG_TCK
F5
UPA_SREPLY0_2
J5
VDD
M5
UPA_PREPLY0_0
R5
UPA_ADDRBUS0_27
C6
UPA_XIR
F6
PM_OUT
J6
VSS
M6
UPA_ADDRBUS0_30
R6
UPA_ADDRBUS0_25
C7
SYS_RESET
F7
VSS
J7
VSS
M7
UPA_ADDRBUS0_26
R7
VDD
C8
CLK–
F8
VSS
J8
VSS
M8
UPA_ADDRBUS0_22
R8
UPA_ADDRBUS0_19
C9
UPA_ECC_VAL_1
F9
VSS
J9
VSS
M9
UPA_ADDRBUS0_14
R9
VSS
C10
UPA_SREPLY1_3
F10
EBUS_DATA_2
J10
VSS
M10
UPA_ADDRBUS0_12
R10
UPA_ADDRBUS0_16
C11
EBUS_DATA_5
F11
UPA_SREPLY2_2
J11
VDD
M11
UPA_ADDRBUS0_03
R11
UPA_ADDRBUS0_11
C12
EBUS_DATA_7
F12
UPA_ADDRBUS1_01
J12
UPA_ADDRBUS1_15
M12
UPA_ADDR0_VAL0_1
R12
VDD
C13
EBUS_ADDR_2
F13
UPA_ADDRBUS1_06
J13
UPA_ADDRBUS1_17
M13
UPA_ADDRBUS1_28
R13
UPA_ADDRBUS0_08
C14
UPA_SREPLY2_0
F14
UPA_ADDRBUS1_03
J14
UPA_ADDRBUS1_11
M14
UPA_ADDRBUS1_25
R14
UPA_ADDRBUS0_02
C15
UPA_PREPLY2_0
F15
UPA_ADDRBUS1_04
J15
VSS
M15
VDD
R15
VSS
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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