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參數(shù)資料
| 型號： | SAFC165H |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| 中文描述： | 嵌入式的C166與國際移民組織的USART - 2和HDLC支持 |
| 文件頁數(shù)： | 59/499頁 |
| 文件大?。?/td> | 6140K |
| 代理商： | SAFC165H |
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C165H
Central Processor Unit
Data Sheet
59
2001-04-19
PRELMNARY
INJECT
)
DECODE
-EXCERPT-
I
n
Cache Jmp
(I
INJECT
)
If a conditional branch is not taken, there is no deviation from the sequential program
flow, and thus no extra time is required. In this case the instruction after the branch
instruction will enter the decode stage of the pipeline at the beginning of the next
machine cycle after decode of the conditional branch instruction.
Cache Jump Instruction Processing
The C165H incorporates a jump cache to optimize conditional jumps, which are
processed repeatedly within a loop. Whenever a jump on cache is taken, the extra time
to fetch the branch target instruction can be saved and thus the corresponding cache
jump instruction in most cases takes only one machine cycle.
This performance is achieved by the following mechanism:
Whenever a cache jump instruction passes through the decode stage of the pipeline for
the first time (and provided that the jump condition is met), the jump target instruction is
fetched as usual, causing a time delay of one machine cycle. In contrast to standard
branch instructions, however, the target instruction of a cache jump instruction (JMPA,
JMPR, JB, JBC, JNB, JNBS) is additionally stored in the cache after having been
fetched.
After each repeatedly following execution of the same cache jump instruction, the jump
target instruction is not fetched from progam memory but taken from the cache and
immediatly injected into the decode stage of the pipeline (see
Figure 15
).
A time saving jump on cache is always taken after the second and any further occurrence
of the same cache jump instruction, unless an instruction which, has the fundamental
capability of changing the CSP register contents (JMPS, CALLS, RETS, TRAP, RETI),
or any standard interrupt has been processed during the period of time between two
following occurrences of the same cache jump instruction.
Figure 15
Cache Jump Instruction Pipelining
I
n+2
Cache Jmp
I
n
. . .
I
TARGET+1
I
TARGET
Cache Jmp
I
n
I
TARGET+2
I
TARGET+1
I
TARGET
Cache Jmp
I
n+2
. . .
I
TARGET
I
n
I
TARGET+1
I
TARGET
Cache Jmp
1 Machine
Cycle
FETCH
EXECUTE
WRITEBACK
1st loop iteration
Injection
Injection of cached
Target Instruction
Repeated loop iteration
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAFC165UTAH | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| SAFC503 | 8-Bit CMOS Microcontroller |
| SAK-C164CI-8EM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-6RM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-8R25M | 16-Bit Single-Chip Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SAF-C165H-LF V1.3 | 功能描述:16位微控制器 - MCU IC COMM CTRLR RISC ROMLESS 36MHZ 3.3V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT |
| SAFC165H-LF V1.3TR | 制造商:Lantiq 功能描述: |
| SAFC165HLFV1.3 | 制造商:Lantiq 功能描述: 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| SAF-C165HLFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165H-LFV1.3 | 制造商:Infineon Technologies AG 功能描述: |
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