- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄374698 > SAFC165H (INFINEON TECHNOLOGIES AG) EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT PDF資料下載
參數(shù)資料
| 型號(hào)： | SAFC165H |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| 中文描述： | 嵌入式的C166與國(guó)際移民組織的USART - 2和HDLC支持 |
| 文件頁(yè)數(shù)： | 105/499頁(yè) |
| 文件大?。?/td> | 6140K |
| 代理商： | SAFC165H |
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C165H
Interrupt and Trap Functions
Data Sheet
105
2001-04-19
PRELMNARY
and does not require to re-enable the interrupt system after the unseparable instruction
sequence (see chapter “System Programming”).
-EXCERPT-
PEC data transfers do not use the data page pointers DPP3...DPP0, see also
Chapter 5.5, "PEC - Extension of Functionality". The PEC source and destination
pointers are used as 16-bit intra-segment addresses within segment 0, so data can be
transferred between any two locations within the first four data pages 3...0.
The pointer locations for inactive PEC channels may be used for general data storage.
Only the required pointers occupy RAM locations.
Note:
If word data transfer is selected for a specific PEC channel (ie. BWT=’0’), the
respective source and destination pointers must both contain a valid word address
which points to an even byte boundary. Otherwise the Illegal Word Access trap will
be invoked, when this channel is used.
6.4
Prioritization of Interrupt and PEC Service Requests
Interrupt and PEC service requests from all sources can be enabled, so they are
arbitrated and serviced (if they win), or they may be disabled, so their requests are
disregarded and not serviced.
Enabling and disabling interrupt requests
may be done via three mechanisms:
Control Bits
allow to switch each individual source “ON” or “OFF”, so it may generate a
request or not. The control bits (xxIE) are located in the respective interrupt control
registers. All interrupt requests may be enabled or disabled generally via bit IEN in
register PSW. This control bit is the “main switch” that selects, if requests from any
source are accepted or not.
For a specific request to be arbitrated the respective source’s enable bit and the global
enable bit must both be set.
The Priority Level
automatically selects a certain group of interrupt requests that will be
acknowledged, disclosing all other requests. The priority level of the source that won the
arbitration is compared against the CPU’s current level and the source is only serviced,
if its level is higher than the current CPU level. Changing the CPU level to a specific value
via software blocks all requests on the same or a lower level. An interrupt source that is
assigned to level 0 will be disabled and never be serviced.
The ATOMIC and EXTend instructions
automatically disable all interrupt requests for
Interrupt Class Management
An interrupt class covers a set of interrupt sources with the same importance, ie. the
same priority from the system’s viewpoint. Interrupts of the same class must not interrupt
each other. The C165H supports this function with two features:
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SAFC165UTAH | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| SAFC503 | 8-Bit CMOS Microcontroller |
| SAK-C164CI-8EM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-6RM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-8R25M | 16-Bit Single-Chip Microcontroller |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SAF-C165H-LF V1.3 | 功能描述:16位微控制器 - MCU IC COMM CTRLR RISC ROMLESS 36MHZ 3.3V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線(xiàn)寬度:16 bit 最大時(shí)鐘頻率:24 MHz 程序存儲(chǔ)器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風(fēng)格:SMD/SMT |
| SAFC165H-LF V1.3TR | 制造商:Lantiq 功能描述: |
| SAFC165HLFV1.3 | 制造商:Lantiq 功能描述: 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| SAF-C165HLFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165H-LFV1.3 | 制造商:Infineon Technologies AG 功能描述: |
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