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參數(shù)資料
| 型號： | SAFC165H |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 英文描述： | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| 中文描述： | 嵌入式的C166與國際移民組織的USART - 2和HDLC支持 |
| 文件頁數(shù)： | 294/499頁 |
| 文件大?。?/td> | 6140K |
| 代理商： | SAFC165H |
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C165H
High-Speed Synchronous Serial Interface
Data Sheet
294
2001-04-19
PRELMNARY
-EXCERPT-
(SSCRIR) will be generated. If no further transfer is to take place (SSCTB is empty),
SSCBSY will be cleared at the same time. Software should not modify SSCBSY, as this
flag is hardware controlled.
Note:
Only one SSC (etc.) can be master at a given time.
The transfer of serial data bits can be programmed in many respects:
the data width can be chosen from 2 bits to 16 bits
transfer may start with the LSB or the MSB
the shift clock may be idle low or idle high
data bits may be shifted with the leading or trailing edge of the clock signal
the baudrate may be set from 274.7 Baud up to 18 MBaud (@ 36 MHz CPU clock)
the shift clock can be generated (master) or received (slave)
This allows the adaptation of the SSC to a wide range of applications, where serial data
transfer is required.
The Data Width Selection
supports the transfer of frames of any length, from 2-bit
“characters” up to 16-bit “characters”. Starting with the LSB (SSCHB=’0’) allows
communication eg. with ASC devices in synchronous mode (C166 family) or 8051 like
serial interfaces. Starting with the MSB (SSCHB=’1’) allows operation compatible with
the SPI interface.
Regardless which data width is selected and whether the MSB or the LSB is transmitted
first, the transfer data is always right aligned in registers SSCTB and SSCRB, with the
LSB of the transfer data in bit 0 of these registers. The data bits are rearranged for
transfer by the internal shift register logic. The unselected bits of SSCTB are ignored, the
unselected bits of SSCRB will be not valid and should be ignored by the receiver service
routine.
The Clock Control
allows the adaptation of transmit and receive behaviour of the SSC
to a variety of serial interfaces. A specific clock edge (rising or falling) is used to shift out
transmit data, while the other clock edge is used to latch in receive data. Bit SSCPH
selects the leading edge or the trailing edge for each function. Bit SSCPO selects the
level of the clock line in the idle state. So for an idle-high clock the leading edge is a
falling one, a 1-to-0 transition. The figure below is a summary.
相關PDF資料 |
PDF描述 |
|---|---|
| SAFC165UTAH | EMBEDDED C166 WITH USART IOM-2 AND HDLC SUPPORT |
| SAFC503 | 8-Bit CMOS Microcontroller |
| SAK-C164CI-8EM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-6RM | 16-Bit Single-Chip Microcontroller |
| SAK-C164CL-8R25M | 16-Bit Single-Chip Microcontroller |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| SAF-C165H-LF V1.3 | 功能描述:16位微控制器 - MCU IC COMM CTRLR RISC ROMLESS 36MHZ 3.3V RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| SAFC165H-LF V1.3TR | 制造商:Lantiq 功能描述: |
| SAFC165HLFV1.3 | 制造商:Lantiq 功能描述: 制造商:Rochester Electronics LLC 功能描述: 制造商:Infineon Technologies AG 功能描述: |
| SAF-C165HLFV1.3 | 制造商:Lantiq 功能描述: |
| SAF-C165H-LFV1.3 | 制造商:Infineon Technologies AG 功能描述: |
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