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參數(shù)資料
| 型號： | S3C3410XXX-QA |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 40 MHz, RISC MICROCONTROLLER, PQFP128 |
| 封裝： | 14 X 20 MM, QFP-128 |
| 文件頁數(shù)： | 14/314頁 |
| 文件大小： | 1701K |
| 代理商： | S3C3410XXX-QA |
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ARM INSTRUCTION SET
S3C3410X RISC MICROPROCESSOR
3-72
FORMAT 5: HI-REGISTER OPERATIONS/BRANCH EXCHANGE
15
0
0
14
10
[2:0] Destination Register
[5:3] Source Register
[6] Hi Operand Flag 2
[7] Hi Operand Flag 1
[9:8] Opcode
6
5
3
2
Rd/Hd
0
13
12
11
Op
Rs/Hs
0
9
8
7
H1
H2
Figure 3-34. Format 5
OPERATION
There are four sets of instructions in this group. The first three allow ADD, CMP and MOV operations to be
performed between Lo and Hi registers, or a pair of Hi registers. The fourth, BX, allows a Branch to be performed
which may also be used to switch processor state. The THUMB assembler syntax is shown in Table 3-12.
NOTE
In this group only CMP (Op = 01) sets the CPSR condition codes.
The action of H1= 0, H2 = 0 for Op = 00 (ADD), Op =01 (CMP) and Op = 10 (MOV) is undefined, and should not
be used.
Table 3-12. Summary of Format 5 Instructions
Op
H1
H2
THUMB assembler
ARM equivalent
Action
00
0
1
ADD Rd, Hs
ADD Rd, Rd, Hs
Add a register in the range 8–15 to a
register in the range 0–7.
00
1
0
ADD Hd, Rs
ADD Hd, Hd, Rs
Add a register in the range 0–7 to a
register in the range 8–15.
00
1
ADD Hd, Hs
ADD Hd, Hd, Hs
Add two registers in the range 8–15
01
0
1
CMP Rd, Hs
Compare a register in the range 0–7
with a register in the range 8–15. Set
the condition code flags on the result.
01
1
0
CMP Hd, Rs
Compare a register in the range 8–15
with a register in the range 0–7. Set
the condition code flags on the result.
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