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參數(shù)資料
| 型號： | RG82845MP |
| 英文描述： | Controller Miscellaneous - Datasheet Reference |
| 中文描述： | 控制器雜項(xiàng)-數(shù)據(jù)表參考 |
| 文件頁數(shù)： | 101/157頁 |
| 文件大?。?/td> | 1407K |
| 代理商： | RG82845MP |
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Intel
82845MP/82845MZ Chipset-Mobile (MCH-M)
48
Datasheet
250687-002
R
3.6.6.
RCVENSTR – Strength Control Register for RCVENOUT#
Signals
Address Offset:
34h
Default Value:
00h
Access:
Read Only, Read/Write
Size:
8 bits
This register controls the drive strength of the I/O buffers for the Receive Enable Out (RCVENOUT#)
signal.
Bit
Descriptions
7:3
Reserved
2:0
RCVEnOut# Strength Control: Sets drive strength as shown below:
000 = 0.75 X (default)
001 = 1.00 X
010 = 1.25 X
011 = 1.50 X
100 = 2.00 X
101 = 2.50 X
110 = 3.00 X
111 = 4.00 X
3.7.
Host-Hub Interface Bridge Device Registers – Device
#0
Table 20 shows the access attributes for the configuration space. An “s” in the Default Value field means
that a strap determines the power-up default value for that bit. Table 21 below summarizes the MCH-M
configuration space for Device #0.
Table 20. Nomenclature for Access Attributes
RO
Read Only. If a register is read only, writes to this register have no effect.
R/W
Read/Write. A register with this attribute can be read and written.
R/W/L
Read/Write/Lock A register with this attribute can be read, written, and Lock.
R/WC
Read/Write Clear. A register bit with this attribute can be read and written. However, a write of a 1
clears (sets to 0) the corresponding bit and a write of a 0 has no effect.
R/WO
Read/Write Once. A register bit with this attribute can be written to only once after power up. After the
first write, the bit becomes read only.
L
Lock. A register bit with this attribute becomes Read Only after a lock bit is set.
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