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參數資料
| 型號： | PM8315-PI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA324 |
| 封裝： | 23 X 23 MM, 2.33 MM HEIGHT, PLASTIC, BGA-324 |
| 文件頁數： | 140/329頁 |
| 文件大?。?/td> | 3024K |
| 代理商： | PM8315-PI |
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STANDARD PRODUCT
PM8315 TEMUX
DATASHEET
PMC-1981125
ISSUE 7
HIGH DENSITY T1/E1 FRAMER WITH
INTEGRATED VT/TU MAPPER AND M13 MUX
PROPRIETARY AND CONFIDENTIAL
125
IFP[x]. In this mode, demultiplexed or demapper T1 or E1 data passes through
the TEMUX unchanged during out-of-frame conditions, similar to an offline
framer system. When the TEMUX is the clock master in the ingress direction,
the elastic store is used to buffer between the ingress and egress clocks to
facilitate per-Channel loopback.
Figure 25
- Clock Master: NxChannel
FRMR
Framer:
Frame Alignment,
Alarm Extraction
ISIF
Ingress
System
Interface
RECEIVER
ID[1:28]
IFP[1:28]
ICLK[1:28]
ID[x], IFP[x]
Timed to
gapped
ICLK[1:28]
Receive Data[1:28]
RJAT
Digital Jitter
Attenuator
Receive CLK[1:28]
FRAM
Framer:
Slip Buffer RAM
In Clock Master: NxChannel mode, ICLK[x] is a gapped version of the jitter
attenuated 1.544 MHz or 2.048 MHz receive clock coming from either the M13
multiplex or SONET/SDH demapper. ICLK[x] is gapped on a per channel basis
so that a subset of the 24 channels in the T1 frame or 32 channels in an E1
frame is extracted on ID[x]. IFP[x] indicates frame alignment but has no clock
since it is gapped during the framing bits. Channel extraction is controlled by the
RPSC block. The framing bit position is always gapped, so the number of
ICLK[x] pulses is controllable from 0 to 192 pulses per T1 frame or 0 to 256
pulses per E1 frame on a per-channel basis. In this mode, demultiplexed or
demapped T1 or E1 streams pass through the TEMUX unchanged during out-of-
frame conditions. The parity functions are not usable in NxChannel mode.
When the TEMUX is the clock master in the ingress direction, the elastic store is
used to buffer between the ingress and egress clocks to facilitate per-Channel
loopback.
Figure 26
- Clock Master: Clear Channel
ISIF
Ingress
System
Interface
RECEIVER
ID[1:28]
ICLK[1:28]
ID[x]Timed to
ICLK[x]
RJAT
Digita l Jitter
Attenuator
Receive CLK[1:28]
Receive Data[1:28]
相關PDF資料 |
PDF描述 |
|---|---|
| PM8316 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8316TEMUX-84 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| PM8351 | 8-Channel 1.0-1.25 Gbps Transceiver |
| PM8353 | 4-Channel 1.0-1.25 Gbps Transceiver |
| PM8355 | 4-Channel 2.125, 2.5 and 3.125 Gbit/s Transceiver with Half-rate Support |
相關代理商/技術參數 |
參數描述 |
|---|---|
| PM8315-PI-P-RFBD | 制造商:PMC-Sierra 功能描述: |
| PM8316 | 制造商:PMC 制造商全稱:PMC 功能描述:High Density 84-Channel T1/E1/J1 Framer with Integrated VT/TU Mappers and M13 |
| PM8316-PI | 制造商:PMC-Sierra 功能描述: |
| PM8316PIP | 制造商:PMC-Sierra 功能描述: |
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