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參數(shù)資料
| 型號： | PM73121-RI |
| 廠商： | PMC-SIERRA INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | AAL1 Segmentation And Reassembly Processor |
| 中文描述： | ATM SEGMENTATION AND REASSEMBLY DEVICE, PQFP240 |
| 封裝： | QFP-240 |
| 文件頁數(shù)： | 38/223頁 |
| 文件大?。?/td> | 2300K |
| 代理商： | PM73121-RI |
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PM73121AAL1gator II
PMC-Sierra, Inc.
L
PMC-980620
,VVXH
AAL1 SAR Processor
Data Sheet
35235,(7$5<$1'&21),'(17,$/7230&6,(55$,1&$1')25,76&86720(56,17(51$/86(
occurrences of each type of event. If a count is required, the counters should be used instead. The
status bits for the receive error conditions on each queue are maintained in a single-data word.
When a set bit is detected, this single-data word should be cleared immediately.
NOTE: As new events can occur between the read of the status bits and the write to clear the
status bits, the status bits should be used for statistics gathering only.
2.6
The AAL1gator II asserts the interrupt line whenever an OAM cell arrives and the interrupt mask
is deasserted. The interrupt can be cleared by asserting OAM_INT_MASK or by asserting CLR_
RX_OAM_LATCH. Refer to
section 7.9 “CMDREG (Command Register)” on page 165
.
Interrupts
2.7
The AAL1gator II provides the following transmit line interface clock configurations on a
per-line basis:
Drives TL_CLK(i) with the looped-back RL_CLK(i).
Drives TL_CLK(i) with the SRTS-derived clock.
Drives TL_CLK(i) with a nominal T1/E1 clock of 1.544 MHz or 2.048 MHz.
Accepts TL_CLK(i) as an input.
SRTS and Transmit Line Interface Clock Configurations
NOTE: The AAL1gator II uses Bellcore’s patented SRTS clock recovery technique. Refer to
the NOTE on
page 172
for additional information regarding Bellcore’s SRTS patent.
The AAL1gator II also provides the following external TL_CLK generation options through the
multiplexed SRTS output port. These options can be used when the AAL1gator II accepts TL_
CLK(i) as an input:
The AAL1gator II drives SRTS information out of the SRTS port. An external circuit can
use this information to synthesize an SRTS-based TL_CLK. (Provided for backward
compatibility with the WAC-021-C-X.)
The AAL1gator II drives adaptive clocking information out of the SRTS port. An external
circuit can use this information to synthesize an adaptive (based on
receive-buffer-centering) TL_CLK.
2.8
For purposes of discussion, the following PCR information is assumed:
Full cells are used,
The PCR numbers are per line, and
The SYS_CLK is 38.88 MHz.
Peak Cell Rates (PCRs)
2.8.1
Peak Cell Rates (PCRs) for Structured Cell Formats
PCR
≤
176
×
n
cells per second where 1
≤
n
≤
32 (assuming completely filled cells).
相關PDF資料 |
PDF描述 |
|---|---|
| PM73122 | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73123 | 8 LINK CES/DBCES AAL1 SAR |
| PM73123-PI | 8 LINK CES/DBCES AAL1 SAR |
| PM73124 | 4 Link CES/DBCES AAL1 SAR |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PM73122 | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BI | 制造商:PMC 制造商全稱:PMC 功能描述:32 LINK CES/DBCES AAL1 SAR PROCESSOR |
| PM73122-BIP | 制造商:PMC-Sierra 功能描述:AAL1GATOR32 EOL270906 |
| PM73122-BI-P | 制造商:PMC-Sierra 功能描述: |
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