參數(shù)資料
型號： MT90869
廠商： Zarlink Semiconductor Inc.
英文描述： Flexible 16K Digital Switch (F16kDX)
中文描述： 靈活的16K的數(shù)字交換機（F16kDX）
文件頁數(shù)： 72/76頁
文件大?。?/td> 1316K
代理商： MT90869
MT90869
Data Sheet
72
Zarlink Semiconductor Inc.
Figure 27 - ST-BUS Local Data Timing Diagram (8Mb/s, 4Mb/s, 2Mb/s)
Note 1: High Impedance is measured by pulling to mid-rail with R
L
= 1k//1k potential divider, with timing corrected for C
L
.
Backplane and Local Output High-Impedance Timing
Characteristic
Sym
Min
Typ
Max
Unit
s
Test Conditions
1
STo delay - Active to High-Z
- High-Z to Active
t
DZ
t
ZD
4
4
ns
ns
R
L
=1K, C
L
=50pF, See Note 1
2
Output Driver Enable (ODE)
Delay to Active Data
Output Driver Enable (ODE)
Delay to High-Impedance
t
ODE
t
ODZ
15
14
ns
ns
R
L
=1K, C
L
=50pF, See Note 1
R
L
=1K, C
L
=50pF, See Note 1
CK_int *
LSTi0 - 31
8.192Mb/s
LSTo0 - 31
8.192Mb/s
t
LIDS8
t
LSIS8
t
LFBOS
FP8o
C8o
t
LIDS4
t
LIDS2
t
LSIH8
t
LSIH4
t
LSIS4
t
LSIH2
t
LSIS2
t
LSOD2
t
LSOD4
t
LSOD8
LSTo0 - 31
4.096Mb/s
LSTo0 - 31
2.048Mb/s
LSTi0 - 31
4.096Mb/s
LSTi0 - 31
2.048Mb/s
Bit7
Bit6
Bit7
Ch0
Bit6
Ch0
Bit0
Bit0
Bit7
Bit6
Bit5
Bit4
Bit7
Bit6
Ch0
Bit0
Bit5
Ch0
Bit4
Bit6
Ch0
Bit7
Bit0
Ch63
Bit1
Bit0
Ch127
Bit5
Ch0
Bit4
Ch0
Bit3
Ch0
Bit2
Ch0
Bit1
6
5
0
4
3
2
1
1
7
* CK_int is the internal clock signal of 131.072MHz
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PDF描述
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參數(shù)描述
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