參數(shù)資料
型號(hào)： MMC2001
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, 34 MHz, RISC PROCESSOR, PQFP144
封裝： PLASTIC, TQFP-144
文件頁(yè)數(shù)： 204/260頁(yè)
文件大小： 3848K
代理商： MMC2001
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MOTOROLA
C-8
PROGRAMMING REFERENCE
MMC2001
REFERENCE MANUAL
Figure C-8 TOD Seconds Register
C.3.4 TOD Fraction Register (TODFR)
The 32-bit time-of-day fraction register holds eight bits of data that represent the
binary fraction of a second. It is clocked by the 32.768-kHz LOW_REFCLK divided by
128 (256 Hz). Reads of this register return the value latched when the TOD seconds
register was previously read. Continuous reads return the same value until the
TODSR is read and new data is latched from the fraction counter. These eight bits
are cleared whenever the TODSR is written but are not affected by either reset pin or
the watchdog reset conditions. The fraction counter is undefined after a POR. Writes
to this register cause all eight bits to be set.
Access this register with 32-bit accesses only.
Figure C-9 TOD Fraction Register
C.3.5 TOD Seconds Alarm Register (TODSAR)
The time-of-day seconds alarm register is a 32-bit read/write register which holds
data (in seconds) to be compared to the TOD seconds register. The comparison is
made every 1/256 of a second if the alarm function is enabled by the AE bit in the
TODCSR. Writes to this register inhibit alarm compares until the TODFAR is written.
For proper alarm operation, the fraction alarm register must be (re)written after a
write to this register. This register is not affected by any of the reset conditions.
Access this register with 32-bit loads and stores only.
TODSR
— Time-of-Day Seconds Register
10001008
31
0
R
W
RESET:
TOD SECONDS REGISTER
Undefined on POR
TODFR
— TOD Fraction Register
1000100C
31
30
29
TOD FRACTION REGISTER
Set to ones
28
27
26
25
24
23
0
22
0
21
0
20
0
19
0
18
0
17
0
16
0
R
W
RESET:
Undefined on POR
15
0
14
0
13
0
12
0
11
0
10
0
9
0
8
0
7
0
6
0
5
0
4
0
3
0
2
0
1
0
0
0
R
W
RESET:
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