參數資料
型號： MMC2001
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： Highly Integrated, Low-Power, 32-Bit Microcontroller
中文描述： 32-BIT, 34 MHz, RISC PROCESSOR, PQFP144
封裝： PLASTIC, TQFP-144
文件頁數： 100/260頁
文件大?。?/td> 3848K
代理商： MMC2001
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MOTOROLA
10-2
INTERRUPT CONTROLLER
MMC2001
REFERENCE MANUAL
In the MMC2001, interrupt requests to the CPU are always treated as autovectored.
The interrupt controller accomplishes this by asserting the CPU AVEC input along
with the appropriate interrupt request. An interrupt handler can read the NIPND or
FIPND register and then vector based on the value received.
The INTSRC register inputs at bit positions [0:2] are reserved for software generation
of interrupts and are always forced to a one. By enabling interrupts for these bit posi-
tions, software can force an interrupt request.
The interrupt requests are prioritized in the following sequence:
1. Fast interrupt requests
2. Normal interrupt requests
The two interrupt lines INT and FINT are mutually exclusive. If FINT is asserted while
INT is already asserted, INT is automatically negated.
10.2 Interrupt Controller Programming Model
Control and status registers for the interrupt controller begin at address 0x40002000.
10.2.1 Interrupt Source Register (INTSRC)
Access the 32-bit interrupt source register with 32-bit loads only.
)LJXUH,QWHUUXSW6RXUFH5HJLVWHU
Table 10-1 Interrupt Controller Address Map
Address
10000000
10000004
10000008
1000000C
10000010
Use
Access
Interrupt Source Register (INTSRC)
Normal Interrupt Enable Register (NIER)
Fast Interrupt Enable Register (FIER)
Normal Interrupt Pending Register (NIPND)
Fast Interrupt Pending Register (FIPND)
Supervisor Only
Supervisor Only
Supervisor Only
Supervisor Only
Supervisor Only
INTSRC
— Interrupt Source Register
10000000
31
IN31
RESET:
30
IN30
29
IN29
28
IN28
27
IN27
26
IN26
25
IN25
24
IN24
23
IN23
22
IN22
21
IN21
20
IN20
19
IN19
18
IN18
17
IN17
16
IN16
15
IN15
RESET:
14
IN14
13
IN13
12
IN12
11
IN11
10
IN10
9
8
7
6
5
4
3
2
1
1
1
0
1
IN9
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IN6
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