- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄377971 > ML53612 (OKI SEMICONDUCTOR CO., LTD.) 64-Channel Full Duplex H.100/H.110 CT Bus System Interface and Time-Slot Interchange PDF資料下載
參數(shù)資料
| 型號： | ML53612 |
| 廠商： | OKI SEMICONDUCTOR CO., LTD. |
| 英文描述： | 64-Channel Full Duplex H.100/H.110 CT Bus System Interface and Time-Slot Interchange |
| 中文描述： | 64通道全雙工H.100/H.110 CT總線系統(tǒng)接口和時隙交換 |
| 文件頁數(shù)： | 24/68頁 |
| 文件大?。?/td> | 696K |
| 代理商： | ML53612 |
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I
ML53612
I
––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––
20
Oki Semiconductor
Configuration Register Byte 3, AR = 0003h
DR_0
C
Definition
[1:0]
[25:24]
SCbus SCLK Frequency [1:0]
2
26
SCbus Master Enable - SCLK, SCLKX2 & FR_COMP
3
27
Reserved
4
28
MVIP-90 Master Enable - C2, C4 & FR_COMP
5
29
H-MVIP Master Enable - C2, C4, C16 & FR_COMP
6
30
Reserved
7
31
Reserved
SCbus SCLK Frequency [1:0] (C_ [25:24]) (Read/Write)
00
01
10
11
→
→
→
→
2.048 MHz (Default)
4.096 MHz
8.192 MHz
Reserved
SCbus Master Enable (C_ [26]) (Read/Write)
When enabled as Primary Master, this register enables the SCLK, SCLKX2 & FR_COMP signals to be driven.
0
→
SCbus Master Disabled (Default)
1
→
SCbus Master Enabled
MVIP-90 Master Enable (C_ [28]) (Read/Write)
When enabled as Primary Master, this register enables the C2, C4 & FR_COMP signals to be driven.
0
→
MVIP-90 Master Disabled (Default)
1
→
MVIP-90 Master Enabled
H-MVIP Master Enable (C_ [29]) (Read/Write)
When enabled as Primary Master, this register enables the C2, C4, C16 & FR_COMP signals to be driven.
0
→
H-MVIP Master Disabled (Default)
1
→
H-MVIP Master Enabled
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PDF描述 |
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參數(shù)描述 |
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