參數(shù)資料
型號(hào)： MB8116165B-60
廠商： Fujitsu Limited
英文描述： 1 M ×16 BIT Hyper Page Mode Dynamic RAM(CMOS 1 M ×16位超級(jí)頁面存取模式動(dòng)態(tài)RAM)
中文描述： 1米× 16位的超頁模式動(dòng)態(tài)RAM的CMOS（1米× 16位超級(jí)頁面存取模式動(dòng)態(tài)內(nèi)存）
文件頁數(shù)： 25/29頁
文件大?。?/td> 575K
代理商： MB8116165B-60
25
MB8116165B-50/-60
t
RC
t
RP
t
CHR
t
RC
t
RAS
t
RAS
t
RP
t
OEL
t
RSH
t
RAH
t
ASC
AR
t
CAH
t
RCS
t
RRH
t
CAC
t
DZC
t
CDD
t
DZO
t
OEA
t
OED
t
OEZ
t
CRP
t
ASR
t
OFF
t
ON
VALID DATA OUT
t
RCD
t
RAL
t
AA
t
RAC
HIGH-Z
HIGH-Z
t
OFR
t
OH
t
RAD
t
OH
LCAS
or
UCAS
DESCRIPTION
A hidden refresh cycle may be performed while maintaining the latest valid data at the output by extending the active time of LCAS
or UCAS and cycling RAS. The refresh row address is provided by the on-chip refresh address counter. This eliminates the need
for the external row address that is required by DRAMs that do not have CAS-before-RAS refresh capability.
Fig. 18 – HIDDEN REFRESH CYCLE
“H” or “L” level (excluding Address and DQ)
“H” or “L” level, “H”
→
“L” or “L”
→
“H” transition (Address and DQ)
A
0
to A
11
V
IH
V
IL
RAS
V
IH
V
IL
V
IH
V
IL
WE
V
IH
V
IL
DQ
(Output)
V
OH
V
OL
DQ
(Input)
V
IH
V
IL
OE
V
IH
V
IL
ROW
ADDRESS
COLUMN
ADDRESS
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PDF描述
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