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參數(shù)資料
| 型號(hào)： | MB8116165B-60 |
| 廠商： | Fujitsu Limited |
| 英文描述： | 1 M ×16 BIT Hyper Page Mode Dynamic RAM(CMOS 1 M ×16位超級(jí)頁(yè)面存取模式動(dòng)態(tài)RAM) |
| 中文描述： | 1米× 16位的超頁(yè)模式動(dòng)態(tài)RAM的CMOS（1米× 16位超級(jí)頁(yè)面存取模式動(dòng)態(tài)內(nèi)存） |
| 文件頁(yè)數(shù)： | 18/29頁(yè) |
| 文件大小： | 575K |
| 代理商： | MB8116165B-60 |
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18
MB8116165B-50/-60
t
RASP
t
ASC
t
RCS
t
RHCP
t
RP
t
RCD
t
CAS
t
RSH
t
HPC
t
CAS
t
DZC
t
CAH
t
CAH
t
RAH
t
ASC
t
RRH
t
CAH
t
ASC
t
RCH
t
CAC
t
RAD
t
RAL
HIGH-Z
t
OFR
HIGH-Z
t
OFF
t
OH
t
OEZ
t
OED
During one cycle is achieved, the input/output timing apply the same manner as the former cycle.
t
RDD
t
OH
t
AA
t
CAC
t
AA
t
ON
t
OEA
t
OEP
t
COL
t
OEA
t
OH
t
OECH
t
OEZ
t
OH
t
OEZ
t
OEA
t
DZO
t
ON
t
RAC
t
AA
t
CP
t
CDD
t
CAC
t
CPA
t
OHC
t
AR
t
CAL
t
CSH
t
CP
t
CRP
t
ASR
LCAS
or
UCAS
V
IH
V
IL
DESCRIPTION
The hyper page mode of operation permits faster successive memory operations at multiple column locations of the same row
address.
This operation is performed by strobing in the row address and maintaining RAS at a Low level and WE at a High level during all
successive memory cycles in which the row address is latched. The address time is determined by t
CAC
, t
AA
, t
CPA
, or t
OEA
, whichever
one is the latest in occurring.
Fig. 10 – HYPER PAGE MODE READ CYCLE (OE = “H” or “L”)
Valid Data
“H” or “L” level (excluding Address and DQ)
“H” or “L” level, “H”
→
“L” or “L”
→
“H” transition (Address and DQ)
A
0
to A
11
V
IH
V
IL
RAS
V
IH
V
IL
WE
V
IH
V
IL
DQ
(Output)
V
OH
V
OL
DQ
(Input)
V
IH
V
IL
OE
V
IH
V
IL
t
CAS
ROW
ADD
COL
ADD
COL
ADD
COL
ADD
t
CPA
t
OH
HIGH-Z
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PDF描述 |
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