M44C890
M44C090
Rev.A4, 14-Dec-01
3 (63)
Table of Contents
1
2
Introduction
MARC4 Architecture
2.1
General Description
2.2
Components of MARC4 Core
2.2.1
2.2.2
2.2.3
2.2.4
2.2.5
2.2.6
2.2.7
5
5
5
6
6
6
7
9
9
9
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ROM
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RAM
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Registers
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ALU
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I/O Bus
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Instruction Set
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Interrupt Structure
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Software Interrupts
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Hardware Interrupts
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Master Reset
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2.3.1
Power-on Reset and Brown-out Detection
2.3.2
Watchdog Reset
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2.3.3
External Clock Supervisor
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Voltage Monitor
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2.4.1
Voltage Monitor Control / Status Register
Clock Generation
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2.5.1
Clock Module
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2.5.2
Oscillator Circuits and External Clock Input Stage
RC-Oscillator 1 Fully Integrated
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External Input Clock
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RC-Oscillator 2 with External Trimming Resistor
4-MHz Oscillator
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32-kHz Oscillator
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2.5.3
Clock Management
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Clock Management Register (CM)
System Configuration Register (SC)
Power-down Modes
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Peripheral Modules
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3.1
Addressing Peripherals
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3.2
Bidirectional Ports
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3.2.1
Bidirectional Port 2
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Port 2 Data Register (P2DAT)
Port 2 Control Register (P2CR)
3.2.2
Bidirectional Port 5
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.2.3
Bidirectional Port 4
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3.3
Universal Timer/Counter / Communication Module (UTCM)
3.3.1
Timer 1
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Timer 1 Control Register 1 (T1C1)
Timer 1 Control Register 2 (T1C2)
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11
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13
13
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14
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25
26
27
27
2.3
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2.4
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2.5
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2.6
3
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